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时钟产生 的查询结果
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单片机开发 一个非常简单的而又实用的电子时钟
一个非常简单的而又实用的电子时钟,是用51单片机写ASM原代码
驱动编程 串口接收和延时产生的PWM波程序
串口接收和延时产生的PWM波程序,调试通过
汇编语言 X1205 是一个带有时钟 振荡器用一个外部的 这样除去了外部的离散元件和一个调整电容 实时时钟用分别的时 存器日历可正确通过2099 年 强大的双报警功能 每个星期二或三月21日上午5:
X1205 是一个带有时钟
振荡器用一个外部的
这样除去了外部的离散元件和一个调整电容
实时时钟用分别的时
存器日历可正确通过2099 年
强大的双报警功能
每个星期二或三月21日上午5:23均可
件的中断IRQ 管脚
该器件提供一个备份电源输入脚V
整个X1205器件的工作电压范围为2.7 V至5.5V 电
到1.8V(待机模式)
引脚排列图
串行 ...
通讯编程文档 此程序在运行的时候,产生一个子进程.此子进程每隔1秒钟,向父进程发送一个SIGUSR1信号,父进程收到信号后,打印当前系统时间.当经过10秒钟后,子进程结束运行,并发送SIGUSR2信号,通知父进程
此程序在运行的时候,产生一个子进程.此子进程每隔1秒钟,向父进程发送一个SIGUSR1信号,父进程收到信号后,打印当前系统时间.当经过10秒钟后,子进程结束运行,并发送SIGUSR2信号,通知父进程 父进程收到SIGUSR2信号后,退出.
VHDL/FPGA/Verilog 一个很小的时钟代码 一个很小的时钟代码 一个很小的时钟代码
一个很小的时钟代码 一个很小的时钟代码 一个很小的时钟代码
matlab例程 用matlab语言实现QPSK调制信号产生
用matlab语言实现QPSK调制信号产生
VHDL/FPGA/Verilog 用VHDL语言写的时钟程序。采用模块化编程。可在EPM7128芯片上下载。编译环境可用Maxplus或Quartus。
用VHDL语言写的时钟程序。采用模块化编程。可在EPM7128芯片上下载。编译环境可用Maxplus或Quartus。
VHDL/FPGA/Verilog 采用MaxPlusII写的一个小时钟程序
采用MaxPlusII写的一个小时钟程序,也是供初学参考。呵呵。注///版主,开发环境里面没有MaxPlusII.
Java书籍 本文介绍EJB的概念、产生
本文介绍EJB的概念、产生,以及具体的编程实例等内容