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时序验证 的查询结果
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单片机开发 IIC的EEPROM AT24C系列的操作源码,C语言实现,经典程序,可直接作为模块文件调用,已验证.
IIC的EEPROM AT24C系列的操作源码,C语言实现,经典程序,可直接作为模块文件调用,已验证.
其他 实现用户验证．．画圆 显示当前系统时间 对ＶＣ很有帮助 1）：修改字体背景色 2）：修改字体颜色 3）：修改字体属性 4）：在工作区画硬币（可以通过菜单栏、工具栏及右键来实现
实现用户验证．．画圆 显示当前系统时间 对ＶＣ很有帮助 1）：修改字体背景色 2）：修改字体颜色 3）：修改字体属性 4）：在工作区画硬币（可以通过菜单栏、工具栏及右键来实现，在状态栏有硬币的数量） 5）：在工作区画一圆（根据用户提出的线的宽度及圆的半径来画圆） 6）：在工作区显示一位图 7）：在工作区可以通过鼠标 ...
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单片机开发 单片机的C语言实现的对RAM进行测试的C语言的源代码。可供单片机开发人员验证RAM时参考。
单片机的C语言实现的对RAM进行测试的C语言的源代码。可供单片机开发人员验证RAM时参考。
VHDL/FPGA/Verilog 大屏幕led点阵显示的驱动时序。 使用vhdl语言描述。其中rom文件可以使用lpm_megcore自动生成。
大屏幕led点阵显示的驱动时序。 使用vhdl语言描述。其中rom文件可以使用lpm_megcore自动生成。
USB编程 usb芯片访问外设——usb和1553b总线的接口访问时序。
usb芯片访问外设——usb和1553b总线的接口访问时序。
DSP编程 使用DSP的片内AD转换器来实现模拟信号的采集！该程序很好用！经过本人验证！
使用DSP的片内AD转换器来实现模拟信号的采集！该程序很好用！经过本人验证！
单片机开发 这是一个结合Proteus和51单片机实现的一个按键加速实例。以验证
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VHDL/FPGA/Verilog verilog 代码. 经验证成功,可以作为标准单元库,为FPGA设计者使用.
verilog 代码. 经验证成功,可以作为标准单元库,为FPGA设计者使用.
VHDL/FPGA/Verilog verilog 代码. 经验证成功,可以作为标准单元库,为FPGA设计者使用.
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