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VHDL/FPGA/Verilog xilinx提供的频率发生器的VHDL源码

xilinx提供的频率发生器的VHDL源码，可以运行在spartan3的学习开发板上。

https://www.eeworm.com/dl/663/223239.html

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单片机开发  频率计是用单片机89C51和几块数字电路几个三极管

频率计是用单片机89C51和几块数字电路几个三极管

https://www.eeworm.com/dl/648/223994.html

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VHDL/FPGA/Verilog 等精度频率计的verilogHDL的实现,我花了好长时间才写的哦

等精度频率计的verilogHDL的实现,我花了好长时间才写的哦

https://www.eeworm.com/dl/663/224175.html

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其他  组合频率干扰,用于通信等射频电路中干扰的计算

组合频率干扰,用于通信等射频电路中干扰的计算

https://www.eeworm.com/dl/534/224715.html

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其他嵌入式/单片机内容  一个基于quartus2的等精度频率计的设计

一个基于quartus2的等精度频率计的设计，主要采用的verilogＨＤＬ语言

https://www.eeworm.com/dl/687/224733.html

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数学计算  利用渐进结构优化算法（ESO）实现矩形板的第一阶频率的最大化。用VC实现界面

利用渐进结构优化算法（ESO）实现矩形板的第一阶频率的最大化。用VC实现界面，以Nastran作为频率求解器，用Matlab进行数值运算。

https://www.eeworm.com/dl/641/224943.html

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系统设计方案  介绍用直接频率合成技术专用芯片实现任意波形发生器

介绍用直接频率合成技术专用芯片实现任意波形发生器

https://www.eeworm.com/dl/678/225027.html

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通讯/手机编程  vc++下实现的不同频率选择的滤波器

vc++下实现的不同频率选择的滤波器，包括FFT变换，各种滤波算法，如果你要编写数字信号处理相关的程序，这是个不错的选择

https://www.eeworm.com/dl/527/225059.html

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DSP编程  1、本试验中未知系统采用25阶的FIR滤波器模拟。其通带边缘频率10kHz

1、本试验中未知系统采用25阶的FIR滤波器模拟。其通带边缘频率10kHz，阻带边缘频率22kHz，阻带衰减75dB，采样频率50 kHz。 2、自适应滤波器采用基本LMS算法，滤波器阶数为32，更新步长u为1/(4+xn*xn)。LMS自适应算法参见《现代信号处理》第192页。已经在DSP2812上实现 ...

https://www.eeworm.com/dl/516/225792.html

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软件设计/软件工程  数字式调频收音机设计介绍利用数字锁相频率合成技术构成收音机的电调谐部分并阐述了收音机的调台、选台、搜索与存储等功能的电路设计原理,着重介绍了用收音机集成芯片CXA1019S构成的FM电路、频率合成

数字式调频收音机设计介绍利用数字锁相频率合成技术构成收音机的电调谐部分并阐述了收音机的调台、选台、搜索与存储等功能的电路设计原理,着重介绍了用收音机集成芯片CXA1019S构成的FM电路、频率合成器芯片BU2614构成的锁相环电路。 ...

https://www.eeworm.com/dl/684/226273.html

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