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VHDL/FPGA/Verilog Verilog HDL编写的四位数码管动态显示程序,外围电路用CPLD来实现

Verilog HDL编写的四位数码管动态显示程序,外围电路用CPLD来实现

https://www.eeworm.com/dl/663/307251.html

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嵌入式/单片机编程  基于数码管的四位动态同步显示

基于数码管的四位动态同步显示，内有asm程序、原理图

https://www.eeworm.com/dl/647/307368.html

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书籍源码  四位数码管顺序显示1-9999.每秒钟刷新一次

四位数码管顺序显示1-9999.每秒钟刷新一次

https://www.eeworm.com/dl/532/309137.html

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VHDL/FPGA/Verilog 用VHDL描述一个让6个数码管同时显示的控制器

用VHDL描述一个让6个数码管同时显示的控制器，同时显示0、1、2、3、4、5这6个不同的数字图形到6个数码管上，输入时钟调节频率，使得能够观察到稳定显示的6个数字。可异步复位

https://www.eeworm.com/dl/663/309548.html

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软件设计/软件工程  用keil写89c51的显示数码管的程序

用keil写89c51的显示数码管的程序，比较简单，有注释，适合初学者

https://www.eeworm.com/dl/684/310270.html

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单片机开发  使用台湾普诚pt6961驱动数码管和按键,显示ds1302的源码,详细的6961驱动代码

使用台湾普诚pt6961驱动数码管和按键,显示ds1302的源码,详细的6961驱动代码

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单片机开发  选择RAO做为模拟输入通道；连续转换4次再求平均值做为转换结果最后结构只取低8位结果送数码管的低3位显示硬件要求：拨码开关S14第2位置ON

选择RAO做为模拟输入通道；连续转换4次再求平均值做为转换结果最后结构只取低8位结果送数码管的低3位显示硬件要求：拨码开关S14第2位置ON，第1位置OFF 拨码开关S6全部置ON，S5第4-6位置ON，第1-3位置OFF 为不影响结果，其他拨码开关置OFF。 ...

https://www.eeworm.com/dl/648/313953.html

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单片机开发  1.走时,六位LED7段数码管接24小时制显示时钟。 2.一个按键实现选曲（2～3首歌）

1.走时,六位LED7段数码管接24小时制显示时钟。 2.一个按键实现选曲（2～3首歌），并且要将所选的曲号通过显示器显示出来。 3.一个按键用来实现播放，播放结束后正常显示时钟，一个按键用来实现停止。 4.通过单片机的P1口的某个输出口驱动喇叭发出不同音节的声音。 ...

https://www.eeworm.com/dl/648/314292.html

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VHDL/FPGA/Verilog 米字型数码管的编码方法。自动循环显示至少四个以上单词。

米字型数码管的编码方法。自动循环显示至少四个以上单词。

https://www.eeworm.com/dl/663/316655.html

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VHDL/FPGA/Verilog 基于北京革新公司出品的EDA实验工具箱的数模转换程序。该程序将输入的5V信号从01至FF量化并通过2位数码管进行显示。量化精度为0.1v。编译环境为quartusll.5.1版本。fpga芯片为EP1

基于北京革新公司出品的EDA实验工具箱的数模转换程序。该程序将输入的5V信号从01至FF量化并通过2位数码管进行显示。量化精度为0.1v。编译环境为quartusll.5.1版本。fpga芯片为EP18CQ240C6

https://www.eeworm.com/dl/663/319967.html

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