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文章/文档  《LCD显示》程序清单: ************************************************************** PCL EQU 2H 定义程序存储器

《LCD显示》程序清单: ************************************************************** PCL EQU 2H 定义程序存储器低字节地址 STATUS EQU 3H 定义状态寄存器地址 PORTA EQU 5H 定义RA口数据寄存器地址 PORTC EQU 7H 定义RC口数据寄存器地址 TRISA EQU 85H 定义RA口方向控制寄存器地址 TRISC EQU 87H 定义RC口方向控制 ...

https://www.eeworm.com/dl/652/251073.html

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行业发展研究  基于低压电力载波的智能电表的设计针对目前的国情以及智能化住宅小区对电能计量系统的要求介绍了一种基于低压电力线载波通信的智能电表的设计方案该方案以微处理单元为核

基于低压电力载波的智能电表的设计针对目前的国情以及智能化住宅小区对电能计量系统的要求介绍了一种基于低压电力线载波通信的智能电表的设计方案该方案以微处理单元为核心以低压电力线作为数据通信的媒介实现了电表数据的自动传送该表计与数据集中器后台管理系统一起构成的多功能低压电力载波远程 ...

https://www.eeworm.com/dl/692/259403.html

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单片机开发  点亮PORTD口上所有的灯

点亮PORTD口上所有的灯，要求定义状态寄存器地址，端口的数据寄存器地址和方向寄存器地址

https://www.eeworm.com/dl/648/282624.html

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VHDL/FPGA/Verilog 用VHDL语言写的程序包含如下功能：1.键盘扫描2.控制AD转换3.产生PWM信号与51系列CPU接口

用VHDL语言写的程序包含如下功能：1.键盘扫描2.控制AD转换3.产生PWM信号与51系列CPU接口，接在51地址数据总线上，单片机通过访问地址总线上的数据寄存器来控制CPLD

https://www.eeworm.com/dl/663/326571.html

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Delphi控件源码  关于verilog的各个基本模块的源代码

关于verilog的各个基本模块的源代码，如加法器，寄存器，选择器及各个测试文件

https://www.eeworm.com/dl/666/342096.html

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VHDL/FPGA/Verilog 很多实用的例程

很多实用的例程，包括触发器，译码器，多路选择器

https://www.eeworm.com/dl/663/348090.html

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Ajax jQuery1.2中文片API详细说明

jQuery1.2中文片API详细说明，chm格式包括的内容：核心、选择器、属性、筛选、文档处理、CSS、事件、效果、AJAX、工具等。

https://www.eeworm.com/dl/702/364893.html

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文章/文档  用VC6.0集成环境快速开发VxD VxD (Virtual Device Driver), 即虚拟设备驱动程序

用VC6.0集成环境快速开发VxD VxD (Virtual Device Driver), 即虚拟设备驱动程序，是运行在处理器Ring0特权级别的驱动程序，可以执行任何处理器指令，访问机器中的任何数据寄存器。VxD被用作Windows 9x系统和物理设备之间的接口,扩展了WINDOWS 系统的核心服务，能够访问和控制实际的硬件环境。 ...

https://www.eeworm.com/dl/652/390529.html

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VHDL/FPGA/Verilog 波形发生器之疏密波的产生

波形发生器之疏密波的产生，这是一个通过内部选择器来从密波和疏波当中在某一该是选择输出的程序。

https://www.eeworm.com/dl/663/403296.html

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嵌入式/单片机编程  16个常用HDL编码打包上传包括记数器

16个常用HDL编码打包上传包括记数器，多路选择器，全加/半加器等，均通过modsim验证

https://www.eeworm.com/dl/647/434253.html

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