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单片机开发  数字频率计的程序

数字频率计的程序，通过汇编语言来编写，并加了很多注释语句，对有点汇编经验的人来说，看懂不是难事。

https://www.eeworm.com/dl/648/293697.html

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系统设计方案  直接数字频率合成器设计

直接数字频率合成器设计

https://www.eeworm.com/dl/678/294745.html

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VHDL/FPGA/Verilog 基于FPGA的直接数字频率合成器的设计与实现.

基于FPGA的直接数字频率合成器的设计与实现.

https://www.eeworm.com/dl/663/300482.html

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DSP编程  基于DSP的直接数字频率合成器的研究和实现.

基于DSP的直接数字频率合成器的研究和实现.

https://www.eeworm.com/dl/516/300484.html

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系统设计方案  基于SOPC技术的直接数字频率合成器设计

基于SOPC技术的直接数字频率合成器设计

https://www.eeworm.com/dl/678/300485.html

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系统设计方案  一种基于锁相环的数字频率合成器的设计

一种基于锁相环的数字频率合成器的设计

https://www.eeworm.com/dl/678/300486.html

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VHDL/FPGA/Verilog 用VHDL设计直接数字频率合成器

用VHDL设计直接数字频率合成器

https://www.eeworm.com/dl/663/300487.html

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单片机开发  本程序实现了一个数字频率计。它由一个测频控制信号发生器TESTCTL

本程序实现了一个数字频率计。它由一个测频控制信号发生器TESTCTL，8个有时钟的十进制计数器CNT10，一个32位锁存器REG32B组成。

https://www.eeworm.com/dl/648/301525.html

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VHDL/FPGA/Verilog 用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.

用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.

https://www.eeworm.com/dl/663/304246.html

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单片机开发  简易数字频率计题解.（ 1997年 B 题）编写与讲解人:田良(东南大学无线电系,2003年3月12日) 一）任务设计并制作一台数字显示的简易频率计。（二）要求 1.基本要求

简易数字频率计题解.（ 1997年 B 题）编写与讲解人:田良(东南大学无线电系,2003年3月12日) 一）任务设计并制作一台数字显示的简易频率计。（二）要求 1.基本要求 (1)频率测量 a.测量范围信号：方波、正弦波幅度：0.5V～5V[注] 频率：1Hz～1MHz b.测试误差≤0.1％ (2)周期测量 a.测量范围信号：方波、正弦波 ...

https://www.eeworm.com/dl/648/307072.html

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