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教程资料  基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计

基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序

https://www.eeworm.com/dl/fpga/doc/17512.html

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教程资料  FPGA实现的直接数字频率合成器

FPGA实现的直接数字频率合成器，本文基于DDS的基本原理,利用Altera公司的FPGA芯片FLEX10系列器件完成了一个DDS系统的设计。

https://www.eeworm.com/dl/fpga/doc/17517.html

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教程资料  数字频率合成 (DDS) 技术的基本原理

摘要：介绍了直接数字频率合成 (DDS) 技术的基本原理，给出了基于Altera公司FPGA器件的一个三相正弦信号发生器的设计方案，同时给出了其软件程序和仿真结果。仿真结果表明：该方法生成的三相正弦信号具有对称性好、波形失真小、频率精度高等优点，且输出频率可调。\r\n关键词：直接数字频率合成；现场可编程门阵列；FPGA； ...

https://www.eeworm.com/dl/fpga/doc/17896.html

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教程资料  基于FPGA的直接数字频率合成器的设计与实现

基于FPGA的直接数字频率合成器的设计与实现.

https://www.eeworm.com/dl/fpga/doc/18200.html

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教程资料  直接数字频率合成（Direct Digital Fraquency Synthesis,即DDFS

直接数字频率合成（Direct Digital Fraquency Synthesis,即DDFS，一般简称DDS）是从相位概念出发直接合成所需要波形的一种新的频率合成技术。

https://www.eeworm.com/dl/fpga/doc/18379.html

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教程资料  在EDA中基于数字频率合成器的FPGA实现

在EDA中，基于数字频率合成器的FPGA实现

https://www.eeworm.com/dl/fpga/doc/18697.html

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教程资料  用vhdl编写的基于fpga的数字频率计程序算法

用vhdl编写的基于fpga的数字频率计程序算法

https://www.eeworm.com/dl/fpga/doc/18807.html

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单片机编程  8位十进制显示数字频率计(带周期)设计报告

8位十进制显示数字频率计(带周期)设计报告

https://www.eeworm.com/dl/502/25335.html

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单片机编程  基于51单片机的数字频率计资料

基于51单片机的数字频率计资料

https://www.eeworm.com/dl/502/25661.html

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单片机编程  单片机C语言简易数字频率计课程设计

单片机C语言简易数字频率计课程设计

https://www.eeworm.com/dl/502/27266.html

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