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模拟电子 XAPP854-数字锁相环(DPLL)参考设计

Many applications require a clock signal to be synchronous, phase-locked, or derived fromanother signal, such as a data signal or another clock. This type of clock circuit is important in
https://www.eeworm.com/dl/571/21275.html
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单片机编程 基于单片机控制的智能微波信号源发生器

介绍了一种用单片机控制的智能微波信号源发生器,以美国国家半导体公司的低功率,高性能的δ-Σ小数分频数字锁相环电路LMX2485和YTO为核心构成.微波信号源的工作频率范围为8~14GHz,频率分辨率为40GHz.分析了设计方案及实现过程中的关键技术,给出了部分实验结果.   ...
https://www.eeworm.com/dl/502/29148.html
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单片机编程 单片机应用技术选编9

单片机应用技术选编(9) 目录 第一章 专题论述1.1 集成电路进入片上系统时代(2)1.2 系统集成芯片综述(10)1.3 Java嵌入技术综述(18)1.4 Java的线程机制(23)1.5 嵌入式系统中的JTAG接口编程技术(29)1.6 EPAC器件技术概述及应用(37)1.7 VHDL设计中电路简化问题的探讨(42)1.8 8031芯片主要模块的VHDL描述与仿真(48)1.9 ISP技术在 ...
https://www.eeworm.com/dl/502/31589.html
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无线通信 FM-DCSK混沌通信系统的原型设计

系统发射部分由Lorenz混沌电路和调频电路产生混沌调频载波信号,经采样后在FPGA中实现差分延时和调制;接收部分基于非相干相关法,位同步模块采用相关值与能量比值作为定时测度,通过设置门限和滑动搜索窗口寻找初始同步,而后引入数字锁相环进行相关峰值跟踪和位同步调整。 ...
https://www.eeworm.com/dl/510/36374.html
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测试测量 基于GPS的恒温晶振频率校准系统的设计与实现

针对目前广泛对高精度频率源的需求,利用FPGA设计一种恒温晶振频率校准系统。系统以GPS接收机提供的秒脉冲信号为基准源,通过结合高精度恒温晶振短期稳定度高与GPS长期稳定特性好、跟踪保持特性强的优点,设计数字锁相环调控恒温晶振的频率。详细阐述系统的设计原理及方法,测试结果表明,恒温晶振的频率可快速被校准到10 M ...
https://www.eeworm.com/dl/544/41506.html
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邮电通讯系统 通信系统中

通信系统中,信号捕获和同步的数字锁相环的MATLAB仿真程序
https://www.eeworm.com/dl/690/139492.html
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matlab例程 在MATLAB环境下

在MATLAB环境下,对全数字锁相环的仿真,分析锁相环的性能参数
https://www.eeworm.com/dl/665/309695.html
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VHDL/FPGA/Verilog 这是基于verilog语言写的

这是基于verilog语言写的,是基于fpga的数字锁相环的设计,用modelsim打开
https://www.eeworm.com/dl/663/324454.html
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其他书籍 这篇文章的目的是

这篇文章的目的是,提出在1960年到1980年期间,对在数字锁相环(DPLL)的领域内完成的理论/试验著作的有系统的调查。数字锁相环描述在前后一致的通讯和跟踪接收机的实施(数字化)过程中需要的组成部分的核心
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源码 dpll的vhdl源代码

dpll的vhdl源代码,完成全数字锁相环的设计,仿真结果通过无误。
https://www.eeworm.com/dl/515771.html
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