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教程资料  基于FPGA设计数字锁相环

基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案

https://www.eeworm.com/dl/fpga/doc/18093.html

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教程资料  基于FPGA的直接数字频率合成器的设计与实现

基于FPGA的直接数字频率合成器的设计与实现.

https://www.eeworm.com/dl/fpga/doc/18200.html

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教程资料  CDMA数字基带收发系统发送部分的FPGA设计与仿真

CDMA数字基带收发系统发送部分的FPGA设计与仿真

https://www.eeworm.com/dl/fpga/doc/18286.html

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教程资料  FPGA数字电子系统设计与开发实例导航光盘内附源码

FPGA数字电子系统设计与开发实例导航光盘内附源码

https://www.eeworm.com/dl/fpga/doc/18422.html

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教程资料  基于FPGA＋DDS的MSK数字调制源设计

基于FPGA＋DDS的MSK数字调制源设计通信中的DDS技术应用

https://www.eeworm.com/dl/fpga/doc/18452.html

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教程资料  使用cpld设计数字系统的完全过程

文中给出了使用cpld设计数字系统的完全过程,希望对初学者有所帮助

https://www.eeworm.com/dl/Protel/doc/18489.html

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教程资料  < FPGA数字电子系统设计与开发实例导航> 一书的代码

< FPGA数字电子系统设计与开发实例导航> 一书的代码，FPGA数字电子系统设计与开发实例导航,用硬件描述语言编写的，I2C,UART,USB，VGA，CAN-BUS，网络等等的书籍配套原代码。。。。\r\n使用方法：\r\n1.拷贝到硬盘。\r\n2.用ISE创建项目，分别加入各个代码文件，即可。 ...

https://www.eeworm.com/dl/fpga/doc/18515.html

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教程资料  一种用CPLD设计GPS数字通道相关器中C／A码产生嚣的方法

摘要本文介绍了一种用CPLD设计GPS数字通道相关器中C／A码产生嚣的方法，详细分析了设计原理并给出了相应的仿真结果．这种设计方法已在我们研制的GPS，GLONASS兼容机中得到实际应用。

https://www.eeworm.com/dl/Protel/doc/18587.html

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教程资料  《FPGA数字电子系统设计与开发实例导航》的配套光盘

《FPGA数字电子系统设计与开发实例导航》的配套光盘，Verilog编写，USB、I2C、MAC的接口设计

https://www.eeworm.com/dl/fpga/doc/18590.html

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教程资料  基于FPGA的直接数字合成器的设计与分析的代码程序,代码格式为VHDL

基于FPGA的直接数字合成器的设计与分析的代码程序,代码格式为VHDL

https://www.eeworm.com/dl/fpga/doc/18599.html

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