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数字钟设计 的查询结果
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VHDL/FPGA/Verilog 数字滤波器设计实例(MatlabVHDL)
数字滤波器设计实例(Matlab\VHDL)
VHDL/FPGA/Verilog 这个程序主要介绍了数字钟用VHDL的写法
这个程序主要介绍了数字钟用VHDL的写法，希望对大家有用
汇编语言 程序1使用延时模拟数字钟的显示过程（进位） 程序0使用定时器做的准确的数字钟
程序1使用延时模拟数字钟的显示过程（进位）
程序0使用定时器做的准确的数字钟
VHDL/FPGA/Verilog VHDL编写的数字钟
VHDL编写的数字钟，在Q-ii下编译，实现闹铃设置与定时闹铃，分时秒显示
汇编语言 LED数码管制作数字钟
LED数码管制作数字钟，一键控制，多种调试，方便快捷
其他数据库 可以用4*4矩阵键盘调整的数字钟
可以用4*4矩阵键盘调整的数字钟，通过动态扫描显示在四位数码管上。
VHDL/FPGA/Verilog 按键在数字电路设计中经常用到。按键的弹跳现象是数字系统设计中存在的客观问题。按键是机械触点
按键在数字电路设计中经常用到。按键的弹跳现象是数字系统设计中存在的客观问题。按键是机械触点，当接触点断开或闭合时会产生抖动。为使每一次按键只做一次响应，就必须去除抖动。本文对按键的抖动信号进行了分析，并通过计数器的方式完成了消除抖动电路模块的设计 ...
系统设计方案 FPGA/CPLD数字电路设计经验分享
FPGA/CPLD数字电路设计经验分享，有助于设计能力提高
单片机开发 基于vriloge的数字钟具有调时、分、秒和定时报警功能
基于vriloge的数字钟具有调时、分、秒和定时报警功能，开发环境是MAXPUII的开发环境，实际检验是完全符合
系统设计方案 专用集成电路设计基础 孙肖子 第4章 数字集成电路设计基础
专用集成电路设计基础 孙肖子
第4章 数字集成电路设计基础