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数字设计 的查询结果
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其他 一个FIFO设计的例子
一个FIFO设计的例子，例子简单，但很经典。
是学好数字设计的好开端。
操作系统开发 一个FIFO设计的例子
一个FIFO设计的例子，例子简单，但很经典。
是学好数字设计的好开端。
技术资料 DC开关电源环路补偿器设计
摘要：建立了数字控制DC/DC开关电源闭环系统的s域小信号模型，采用数字重设计法针对给定的系统季数设计了数字补偿器。应用SISO Design Tool仿真平台，在伯德图分析和根轨连法的基础上设计了连续城的模拟补偿器，并进行了离散化处理。在建立系统s城模型时引入了模数转换器和数字脉宽调制发生器产生的延迟效应，使补偿器的设 ...
VIP专区 20本高速电路设计仿真相关经典书籍电子书汇总
中兴仿真分册.pdf
4.9M2020-03-03 15:50
HyperLynx仿真与PCB设计 张海风 著 306页 67.9M.pdf
66.4M2020-03-03 15:50
数字信号完整性：互连、封装的建模与仿真.pdf
28.8M2020-03-03 15:50
Cadence 高速电路板设计与仿真--信号与电源完整性分析.pdf
66.7M2020-03-03 15:50
SPECCTRAQuest电源完整性设计指导.pdf
2M2020-03-03 ...
技术书籍 高速数字设计
·【原 书 名】 High-Speed Digital Design:A Handbook of Black Magic  【原出版社】 Addison Wesley/Pearson  【作 者】[美]Howard Johnson,Martin Graham [同作者作品] [作译者介绍]  【译 者】 沈立[同译者作品] 朱来文 陈宏伟 等  【丛 书 ...
教程资料 计PLD/FPGA时通常采用几种时钟类型
无沦是用离散逻辑、可编程逻辑，还是用全定制硅器件实现的任何数字设计，为了成功地操\r\n作，可靠的时钟是非常关键的。设计不良的时钟在极限的温度、电压或制造工艺的偏差情况下将\r\n导致错误的行为，并且调试困难、花销很大。 在设计PLD/FPGA时通常采用几种时钟类型。时钟可\r\n分为如下四种类型：全局时钟、门控时钟、 ...
测试测量 深入了解逻辑仪
与许多电子检测与测量工具相同，逻辑分析仪是针对特定问题提供的解决方案。该工具能够帮助人们实施数字硬件故障检测，功能多样；同时，它还是设计数字电路的工程师必不可少的数字设计工具。逻辑分析仪用于涉及大量信号或复杂的触发器要求的数字测量。本文档将使您了解什么是逻辑分析仪，它如何工作。在逻辑分析仪简介部分中 ...
电子书籍 无沦是用离散逻辑、可编程逻辑
无沦是用离散逻辑、可编程逻辑，还是用全定制硅器件实现的任何数字设计，为了成功地操
作，可靠的时钟是非常关键的。设计不良的时钟在极限的温度、电压或制造工艺的偏差情况下将
导致错误的行为，并且调试困难、花销很大。 在设计PLD/FPGA时通常采用几种时钟类型。时钟可
分为如下四种类型：全局时钟、门控时钟、多级逻辑时 ...
其他书籍 Clifford E. Cummings经典论文合集
Clifford E. Cummings经典论文合集，用于ASIC数字设计．