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数字编码器 的查询结果
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DSP编程 数字陷波器的设计
陷波器是无限冲击响应(IIR)数字滤波器，该滤波器可以用以下常系数线性差分方程表示：ΣΣ==−−−=MiNiiiinybinxany01)()()( (1)式中： x(n)和y(n)分别为输人和输出信号序列；和为滤波器系数。 iaib对式(1)两边进行z变换，得到数字滤波器的传递函数为： ΠΠΣΣ===−=−−−==NiiMiiNi ...
教程资料 基于FPGA的宽带数字接收机变带宽数字下变频器设计
基于FPGA芯片Stratix II EP2S60F672C4设计了一个适用于宽带数字接收机的带宽可变的数字下变频器（VB-DDC）。该VB-DDC结合传统数字下变频结构与多相滤波结构的优点，实现了对输入中频信号的高效高速处理，同时可以在较大范围内对信号处理带宽灵活配置。硬件调试结果验证了本设计的有效性。 ...
可编程逻辑 基于FPGA的宽带数字接收机变带宽数字下变频器设计
基于FPGA芯片Stratix II EP2S60F672C4设计了一个适用于宽带数字接收机的带宽可变的数字下变频器（VB-DDC）。该VB-DDC结合传统数字下变频结构与多相滤波结构的优点，实现了对输入中频信号的高效高速处理，同时可以在较大范围内对信号处理带宽灵活配置。硬件调试结果验证了本设计的有效性。 ...
工控技术 数字旋转编码开关的原理及使用方法
数字旋转编码开关的原理及使用方法，图文并茂
Internet/网络编程 编码、通信中移位寄存器综合
编码、通信中移位寄存器综合
压缩解压 杜比AC-3编码解码器（参考程序）
杜比AC-3编码解码器（参考程序）
语音压缩 语音技术（VOIP）中常用的编码解码器（codess）源码
语音技术（VOIP）中常用的编码解码器（codess）源码
VHDL/FPGA/Verilog 数字密码引爆器的输入描述：1、 在开始输入密码以前的等待状态
数字密码引爆器的输入描述：1、 在开始输入密码以前的等待状态，首先要按READY键，表示目前准备就绪，可以输入数字密码；2、 当引爆事件发生后，应该回到等待状态，设置WAIT_T键；3、 如果输入密码不正确，此时要操作READY和WAIT_T是不起作用的，必须由设计人员重新设置到等待状态，设置SETUP键，SETUP为内部按键，操作人员 ...
网络 一个曼彻斯特编码解码器以及差分曼彻斯特编码解码程序
一个曼彻斯特编码解码器以及差分曼彻斯特编码解码程序，Vc＋＋6下编译通过