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matlab例程  在MATLAB环境下

在MATLAB环境下，对全数字锁相环的仿真，分析锁相环的性能参数

https://www.eeworm.com/dl/665/309695.html

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通讯/手机编程  2MHz的数据时钟恢复电路

2MHz的数据时钟恢复电路，包括鉴相器、分频器及滤波器

https://www.eeworm.com/dl/527/312182.html

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VHDL/FPGA/Verilog 这是基于verilog语言写的

这是基于verilog语言写的，是基于fpga的数字锁相环的设计，用modelsim打开

https://www.eeworm.com/dl/663/324454.html

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汇编语言  扰乱加密

扰乱加密，加扰之前的数据在x中，加扰后数据在w中,p,p+1与p+2中分别放移存器低14位中14位和高14位 *q,q+1与q+2中分别放掩码标志码低14位中14位和高14位

https://www.eeworm.com/dl/644/375513.html

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其他书籍  这篇文章的目的是

这篇文章的目的是，提出在1960年到1980年期间，对在数字锁相环(DPLL)的领域内完成的理论/试验著作的有系统的调查。数字锁相环描述在前后一致的通讯和跟踪接收机的实施(数字化)过程中需要的组成部分的核心

https://www.eeworm.com/dl/542/435606.html

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VHDL/FPGA/Verilog dpll的verilog代码

dpll的verilog代码，完成数字锁相。用于时钟对准，位同步。

https://www.eeworm.com/dl/663/460845.html

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其他  基于matlab中simulink的频率合成器的设计

基于matlab中simulink的频率合成器的设计，主要结构包括鉴相器，低通滤波器，压控振荡器

https://www.eeworm.com/dl/534/491105.html

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源码  dpll的vhdl源代码

dpll的vhdl源代码，完成全数字锁相环的设计，仿真结果通过无误。

https://www.eeworm.com/dl/515771.html

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软件  ADF4351

该模块为锁相环模块，内部集成了鉴相器，低通滤波器，压控振荡器。此文件为该模块的配置程序。

https://www.eeworm.com/dl/520396.html

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教程  常用电子器件管脚排列图

逻辑符号对照示例逻辑非、逻辑极性符号对照示例(以反相器为例) 

https://www.eeworm.com/dl/522908.html

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