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数字移相器 的查询结果
VHDL/FPGA/Verilog 数字式移相信号发生器可以产生预置频率的正弦信号
数字式移相信号发生器可以产生预置频率的正弦信号，也可产生预置相位差的两路同频正弦信号，并能显示预置频率或相位差值；
软件设计/软件工程 全数字锁相环ＶＨＤＬ描述并实现功能仿真
全数字锁相环ＶＨＤＬ描述并实现功能仿真，另附有图形说明
邮电通讯系统 直接式数字锁相环频率合成器.用ELANIX公司SYSTEMVIEW运行.
直接式数字锁相环频率合成器.用ELANIX公司SYSTEMVIEW运行.
系统设计方案 DDS移相正弦信号发生器的设计方案
DDS移相正弦信号发生器的设计方案，PPT
通讯/手机编程 一种改进的全数字锁相环设计 一种改进的全数字锁相环设计
一种改进的全数字锁相环设计
一种改进的全数字锁相环设计
VHDL/FPGA/Verilog 比较好的技术文章《基于VHDL的全数字锁相环的设计》有关键部分的源代码。
比较好的技术文章《基于VHDL的全数字锁相环的设计》有关键部分的源代码。
文章/文档 技术文章《自采样比例积分控制全数字锁相环的性能分析和实现》有一定参考价值
技术文章《自采样比例积分控制全数字锁相环的性能分析和实现》有一定参考价值
系统设计方案 电路由CD4069六反相器和74LS30八输入一输出与非门,可控硅电路组成的六路断路,二路闭路多路报警器,
电路由CD4069六反相器和74LS30八输入一输出与非门,可控硅电路组成的六路断路,二路闭路多路报警器,
通讯/手机编程 这是一个SSB移相法分析信号的Systemview源代码。
这是一个SSB移相法分析信号的Systemview源代码。
VHDL/FPGA/Verilog 用一片CPLD实现数字锁相环,用VHDL或V语言.
用一片CPLD实现数字锁相环,用VHDL或V语言.