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https://www.eeworm.com/dl/506148.html 电子书籍

宽带无线数字通信 433页 10.6M.pdf

超声,红外,激光,无线,通讯相关专辑 183册 1.48G宽带无线数字通信 433页 10.6M.pdf
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https://www.eeworm.com/dl/506164.html 电子书籍

数字通信网络 201页 5.1M.pdf

超声,红外,激光,无线,通讯相关专辑 183册 1.48G数字通信网络 201页 5.1M.pdf
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https://www.eeworm.com/dl/506690.html 技术书籍

数字选择性呼叫DSC在GMDSS中的作用

本文 简要 地介绍 了数 : 学选择性 呼 叫 来统 的 组 成 ( ) D S C 、 各 主 要 部 分 的 工 作原理 及 的 一 般工 作程 序。
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https://www.eeworm.com/dl/506855.html 设计相关

数字幅频均衡的功率放大器

基于FPGA的数字均衡电路的设计，其中包含multisim和matlab的仿真设计
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https://www.eeworm.com/dl/508903.html 学术论文

FIR数字滤波器的FPGA实现研究

采用Verilog HDL语言分剐实现了FIR数字滤波器的改进的串行结构、 并行结构以及DA结构，并在ModelSim仿真验证平台中仿真了实现设计。
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https://www.eeworm.com/dl/510789.html 单片机

基于8051单片机c语言设计的数字时钟

基于proteus 51系列单片机仿真 1时间计数电路采用24进制，从00开始到23后再回到00。用数码管显示时分秒！ 2具有报时功能，当时间达到整点时前x秒报时，蜂鸣器1秒响1秒停地响5次。加指示灯！ 3为保证计时稳定，须由晶体振荡器提供时间基准信号！ 4由一个数码管显示星期，星期计数采用7进 ...
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https://www.eeworm.com/dl/511979.html 经验分享

数字信号处理系统及系统响应报告

这是数字信号处理的相关于系统及系统响应实验的报告
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https://www.eeworm.com/dl/512030.html 技术书籍

CPLD数字电路设计使用MAX+PlusⅡ（1）

CPLD数字电路设计使用MAX+PlusⅡ（完整版） 扫描版经典硬件设计书记
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https://www.eeworm.com/dl/512031.html 技术书籍

CPLD数字电路设计使用MAX+PlusⅡ（2）

CPLD数字电路设计使用MAX+PlusⅡ（完整版） ，硬件电路设计适合初学者
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https://www.eeworm.com/dl/512032.html 技术书籍

CPLD数字电路设计使用MAX+PlusⅡ（3）

CPLD数字电路设计使用MAX+PlusⅡ（完整版） ，硬件电路设计适合初学者
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