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汇编语言  数字钟... 汇编原程序.

数字钟... 汇编原程序.

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其他  多功能电子数字钟vhdl 计算机专业课程设计必备

多功能电子数字钟vhdl 计算机专业课程设计必备

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软件设计/软件工程  基于vhdl的数字钟有闹钟,秒表,时钟,日期等功能秒表可以开始,暂停,清零, 时钟可以设置时间, 还可以设置日期

基于vhdl的数字钟有闹钟,秒表,时钟,日期等功能秒表可以开始,暂停,清零, 时钟可以设置时间, 还可以设置日期

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汇编语言  89c51的数字钟程序

89c51的数字钟程序，在keil里边一。当弹道弹道弹道弹道导弹

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文章/文档  vhdl设计的简易数字钟

vhdl设计的简易数字钟，里面有报告的模板，设计思想，设计图，模块代码，简单易懂。

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VHDL/FPGA/Verilog 基于Verilog HDL设计的多功能数字钟

基于Verilog HDL设计的多功能数字钟，有兴趣的

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单片机开发  关于我的数字钟的设计,设计一个24小时的数字闹钟

关于我的数字钟的设计,设计一个24小时的数字闹钟，该数字闹钟的面板如图9.1所示,它包括以下几个组成部分：(1)显示屏，由7个七段数码管组成，其中6个用于显示当前时间(时：分：秒)或设置的闹钟时间，而另一个则用于显示系统内部产生的周期性循环变化的待选预置数字； (2)YES（确认）键：用于输入新的时间或新的闹钟时间时， ...

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VHDL/FPGA/Verilog 基于FPGA的多功能数字钟Verilog设计2007-06-17 21:06基本功能： 1．具有时、分、秒计数显示功能（6位数码管构成）

基于FPGA的多功能数字钟Verilog设计2007-06-17 21:06基本功能： 1．具有时、分、秒计数显示功能（6位数码管构成），以24小时循环为计时基准。 2. 具有调节小时、分钟的功能。 3．具有整点报时功能，整点报时的同时数码管显示闪烁提示。 ...

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VHDL/FPGA/Verilog VHDL硬件描述语言与数字逻辑电路设计

VHDL硬件描述语言与数字逻辑电路设计，需要的朋友可以下载。

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软件设计/软件工程  EDA大作业设计报告题目：数字钟的设计与制作学年：学期：第二学期专业：电子信息工程

EDA大作业设计报告题目：数字钟的设计与制作学年：学期：第二学期专业：电子信息工程

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