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数字电路测试 的查询结果
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PCB相关 Electronic Workbench V5.0c/5.2（汉化版）
     ELECTRONICS  WORKBENCH  EDA（以下简称EWB）软件是交互图像技术有限公司（INTERACTIVE  IMAGE  TECHNOLOGIES  Ltd）在八十年代末推出的EDA软件，其EWB5.0于96年推出，占用硬盘空间很小，只有16M，是个模拟电路和数字电路混合仿真的EDA软件，它的仿真功能十分强大，可以 ...
可编程逻辑 中兴通讯硬件巨作:信号完整性基础知识
中兴通讯硬件一部巨作－信号完整性
近年来，通讯技术、计算机技术的发展越来越快，高速数字电路在设计中的运用越来
越多，数字接入设备的交换能力已从百兆、千兆发展到几十千兆。高速数字电路设计对信
号完整性技术的需求越来越迫切。
在中、 大规模电子系统的设计中， 系统地综合运用信号完整性技术可以带来很多好处 ...
可编程逻辑 Synplify_Pro9.6.2.part01
做数字电路非常好的综合工具，完全破解了的，一共23个文件
可编程逻辑 FPGACPLD数字电路设计经验
FPGA CPLD已成为业界焦点，这篇经验总结出自高人之手
可编程逻辑 vhdl 与数字电路设计
VHDL程序讲解，配合实例，适合初学者，大学期间可用
可编程逻辑 高速PCB设计中的反射研究
 
在高速数字电路飞速发展的今天，信号的频率不断提高, 信号完整性设计在P C B设计中显得日益重要。其中由于传输线效应所引起的信号反射问题是信号完整性的一个重要方面。本文研究分析了高速PCB 设计中的反射问题的产生原因，并利用HyperLynx 软件进行了仿真，最后提出了相应的解决方法。 ...
可编程逻辑 差分线对的PCB设计要点
 
信号完整性是高速数字系统中要解决的一个首要问题之一，如何在高速PCB 设计过程中充分考虑信号完整性因素,并采取有效的控制措施,已经成为当今系统设计能否成功的关键。在这方面，差分线对具有很多优势，比如更高的比特率 ,更低的功耗 ,更好的噪声性能和更稳定的可靠性等。目前，差分线对在高速数字电路设计中的 ...
可编程逻辑 基于FPGA的时钟跟踪环路的设计
提出了一种基于FPGA的时钟跟踪环路的设计方案,该方案简化了时钟跟踪环路的结构,降低了时钟调整电路的复杂度。实际电路测试结果表明,该方案能够使接收机时钟快速准确地跟踪发射机时钟的变化,且时钟抖动小、稳准度高、工作稳定可靠。 ...
可编程逻辑 华为 FPGA设计高级技巧Xilinx篇
随着HDL Hardware Description Language 硬件描述语言语言综合工具及其它相关工具的推广使广大设计工程师从以往烦琐的画原理图连线等工作解脱开来能够将工作重心转移到功能实现上极大地提高了工作效率任何事务都是一分为二的有利就有弊我们发现现在越来越多的工程师不关心自己的电路实现形式以为我只要将功能描述正确其 ...