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教程资料  制作CPLD电路实验板的方法及步骤

本文详细介绍了制作电路板的方法及步骤.\r\n实验板的功能\r\n这个实验板可以做如下实验：\r\n1．可以进行运算器（加、减、乘和除法）、比较器、译码器、编码器、选择器、分配器和一般组合电路的实验\r\n2．可以进行触发器、寄存器、计数器和一般时序电路的实验\r\n3．可以进行频率计电路、时钟电路、计时电路、交通灯等复杂 ...

https://www.eeworm.com/dl/Protel/doc/18586.html

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教程资料  一种用CPLD设计GPS数字通道相关器中C／A码产生嚣的方法

摘要本文介绍了一种用CPLD设计GPS数字通道相关器中C／A码产生嚣的方法，详细分析了设计原理并给出了相应的仿真结果．这种设计方法已在我们研制的GPS，GLONASS兼容机中得到实际应用。

https://www.eeworm.com/dl/Protel/doc/18587.html

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教程资料  《FPGA数字电子系统设计与开发实例导航》的配套光盘

《FPGA数字电子系统设计与开发实例导航》的配套光盘，Verilog编写，USB、I2C、MAC的接口设计

https://www.eeworm.com/dl/fpga/doc/18590.html

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教程资料  EDA 实验原代码包括数字脉冲触发器和交通灯等

EDA 实验原代码包括数字脉冲触发器和交通灯等

https://www.eeworm.com/dl/fpga/doc/18591.html

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教程资料  基于FPGA的直接数字合成器的设计与分析的代码程序,代码格式为VHDL

基于FPGA的直接数字合成器的设计与分析的代码程序,代码格式为VHDL

https://www.eeworm.com/dl/fpga/doc/18599.html

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教程资料  ＦＰＧＡ数字钟的设计

ＦＰＧＡ数字钟的设计，用VHDL语言编程，max+plus仿真，可在实际电路中验证

https://www.eeworm.com/dl/fpga/doc/18614.html

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教程资料  数字设计——CPLD应用与VHDL源文件

数字设计——CPLD应用与VHDL源文件，很不错的，希望能对大家有用

https://www.eeworm.com/dl/Protel/doc/18632.html

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教程资料  CPLD数字电路设计硬件描述语言一例

CPLD数字电路设计硬件描述语言一例+一本经典教材，入门专用

https://www.eeworm.com/dl/Protel/doc/18684.html

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教程资料  在EDA中基于数字频率合成器的FPGA实现

在EDA中，基于数字频率合成器的FPGA实现

https://www.eeworm.com/dl/fpga/doc/18697.html

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教程资料  计PLD/FPGA时通常采用几种时钟类型

无沦是用离散逻辑、可编程逻辑，还是用全定制硅器件实现的任何数字设计，为了成功地操\r\n作，可靠的时钟是非常关键的。设计不良的时钟在极限的温度、电压或制造工艺的偏差情况下将\r\n导致错误的行为，并且调试困难、花销很大。在设计PLD/FPGA时通常采用几种时钟类型。时钟可\r\n分为如下四种类型：全局时钟、门控时钟、 ...

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