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教程资料  MAXPLUS_环境下的频率计设计及其完善

MAXPLUS_环境下的频率计设计及其完善

https://www.eeworm.com/dl/Protel/doc/17671.html

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教程资料  FPGACPLD数字电路设计经验分享

FPGACPLD数字电路设计经验分享，CPLD

https://www.eeworm.com/dl/fpga/doc/17706.html

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教程资料  FPGA/CPLD数字电路设计经验分享

FPGA/CPLD数字电路设计经验分享,包含许多常见设计问题。

https://www.eeworm.com/dl/fpga/doc/17735.html

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教程资料  通过VHDL语言进行数字信号处理的FIR操作

通过VHDL语言进行数字信号处理的FIR操作，可以很好的实现滤波功能，有很好的作用，

https://www.eeworm.com/dl/fpga/doc/17737.html

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教程资料  常用数字逻辑功能都在CPLD器件上用VHDL语言实现

利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点 ...

https://www.eeworm.com/dl/Protel/doc/17751.html

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教程资料  对硅微谐振式加速度计的数据采集电路开展研究工作

项目的研究内容是对硅微谐振式加速度计的数据采集电路开展研究工作。硅微谐振式加速度计敏感结构输出的是两路差分的频率信号，因此硅微谐振式加速度计数据采集电路完成的主要任务是测出两路频率信号的差值。测量要求是：实现10ms内对中心谐振频率为20kHz、标度因数为100Hz/g、量程为±50g、分辨率为1mg的硅微谐振式加速度计 ...

https://www.eeworm.com/dl/Protel/doc/17754.html

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教程资料  设计了一种基于ＣＰＬＤ（复杂可编程逻辑器件）的低频数字相位测量仪

设计了一种基于ＣＰＬＤ（复杂可编程逻辑器件）的低频数字相位测量仪

https://www.eeworm.com/dl/Protel/doc/17758.html

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教程资料  基于FPGA的可编程数字滤波器系统

基于FPGA的可编程数字滤波器系统,基于FPGA的数字滤波器的设计与实现,基于FPGA流水线分布式算法的FIR滤波器的实现

https://www.eeworm.com/dl/fpga/doc/17760.html

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教程资料  应用VHDL技术设计嵌入式全数字锁相环路的方法

介绍了应用VHDL技术设计嵌入式全数字锁相环路的方法，详细叙述了其工作原理和设计思想，并用可编程逻辑器件FPGA实现。

https://www.eeworm.com/dl/fpga/doc/17765.html

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教程资料  《FPGA数字电子系统设计与开发实例导航》的配套光盘

《FPGA数字电子系统设计与开发实例导航》的配套光盘，Verilog编写，USB、I2C、MAC的接口设计

https://www.eeworm.com/dl/fpga/doc/17812.html

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