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VHDL/FPGA/Verilog 数字均衡器是通讯信道抗码间干扰的重要环节,这是一个用vhdl写的代码以及用SYNPLIFY8.0综合的RTL电路图它包含三个模块FILTER,ERR_DECISION,ADJUST 希望对大家有用.

数字均衡器是通讯信道抗码间干扰的重要环节,这是一个用vhdl写的代码以及用SYNPLIFY8.0综合的RTL电路图它包含三个模块FILTER,ERR_DECISION,ADJUST 希望对大家有用.

https://www.eeworm.com/dl/663/162264.html

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VHDL/FPGA/Verilog 使用FPGA控制数码管,在数码管上动态的显示数字,很使用,可以直接作为其他模块的子模块,直接调用

使用FPGA控制数码管,在数码管上动态的显示数字,很使用,可以直接作为其他模块的子模块,直接调用

https://www.eeworm.com/dl/663/164162.html

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单片机开发  液晶显示模块1604测试源码。显示数字

液晶显示模块1604测试源码。显示数字，使用汇编语言编写。

https://www.eeworm.com/dl/648/168145.html

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单片机开发  本文介绍了一种基于DS18B20的数字温度计设计方案。方案利用AT89S52单片机控制DS18B20进行数据采集并由HS1602液晶显示模块显示结果

本文介绍了一种基于DS18B20的数字温度计设计方案。方案利用AT89S52单片机控制DS18B20进行数据采集并由HS1602液晶显示模块显示结果，另外，采集结果可由RS-232-C接口送入计算机显示并存储。按键控制实现过界报警温度设定和实时监控，利用AT24C08芯片进行存储，实现温度测量存储与再现。 ...

https://www.eeworm.com/dl/648/179907.html

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VHDL/FPGA/Verilog I60BCD是一个数字钟的显示模块

I60BCD是一个数字钟的显示模块，你也可以把它改装成别的器械显示用

https://www.eeworm.com/dl/663/193808.html

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系统设计方案  CPLD、FPGA在EL显示模块及接口电路中的应用,cpld实现数字电路取代

CPLD、FPGA在EL显示模块及接口电路中的应用,cpld实现数字电路取代，fpga取代液晶显示专用控制芯片。

https://www.eeworm.com/dl/678/198118.html

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电子书籍  ti dsp tms320lf2407 six 第6章数字输入输出模块

ti dsp tms320lf2407 six 第6章数字输入输出模块

https://www.eeworm.com/dl/cadence/ebook/205638.html

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软件工程  数字视频监控前端模块的设计与实现

数字视频监控前端模块的设计与实现，供大家参考，希望保护作者的知识产权．

https://www.eeworm.com/dl/540/207342.html

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通讯编程文档  利用MATLAB/Simulink软件中Communication Blockets(通信模块)对PSK数字传输系统进行动态、可视化仿真

利用MATLAB/Simulink软件中Communication Blockets(通信模块)对PSK数字传输系统进行动态、可视化仿真，清晰地表现出PSK传输系统的系统组成及各项性能指标。

https://www.eeworm.com/dl/646/212144.html

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数学计算  数字电话各模块的独立M文件实现

数字电话各模块的独立M文件实现，及系统功能的实现。

https://www.eeworm.com/dl/641/214067.html

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