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技术资料 eda课设\VHDL语言数字秒表设计
在eda课程设计中要求用VHDL语言设计一个数字秒表 源码及课题报告如下
技术资料 数字频率计的设计
时钟基准模块主要是为了产生1Hz的方波信号,作为测频控制模块的时钟输入。系统的基准时钟输入为20MHz/256=78125Hz,所以为得到1Hz的时钟信号,必须对输入时钟进行78125次分频。由于是奇数倍分频,可利用时钟下降沿比上升沿延迟半个周期的性质得到1Hz的方波信号。 ...
技术资料 智能全数字锁相环的设计
在FPGA片内实现全数字锁相环用途极广。本文在集成数字锁相环74297的基础上进行改进,设计了锁相状态检测电路,配合CPU对环路滤波参数进行动态智能配置,从而使锁相环快速进入锁定状态,在最短时间内正常工作并且提高输出频率的质量 ...
技术资料 dsp数字滤波器设计
毕业设计,基于dsp平台的数字滤波器设计
技术资料 数字通信原理——基于Matlab仿真计算
《数字通信原理——基于Matlab仿真计算》07版
技术资料 基于VHDL的数字电子钟设计
能够实现小时(24进制)、分钟和秒钟(60进制)的计数功能/具有复位功能/整点报时提示、定时闹钟等功能
在软件工具平台上,进行VHDL语言的各模块编程输入、编译实现和仿真验证。
技术资料 基于单片机的数字闹钟设计
基于单片机的数字闹钟设计
技术资料 数字调制方式识别的FPGA实现
介绍了数字调制方式识别的概念,研究现状,实现方法和一个可供参考的FPGA实现流程。
技术资料 数字信号处理C语言程序集
基于matlab 的 数字信号处理C语言程序集,讲解了各种数字信号处理的DSP