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找到约 291 项符合 抢答 的查询结果

嵌入式/单片机编程 P1.0-P1.7为八路抢答输入 数码管段选P0口

P1.0-P1.7为八路抢答输入 数码管段选P0口,位选P2口,蜂鸣器输出为P3.6口。 P3.0为开始抢答,P3.7为停止。
https://www.eeworm.com/dl/647/427755.html
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汇编语言 基于ATmega16L 单片机的六路抢答器设计

基于ATmega16L 单片机的六路抢答器设计,可完成抢答器的基本功能
https://www.eeworm.com/dl/644/430053.html
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单片机开发 一款抢答器 界面友好 功能完善 支持断开重连 可在娱乐竞赛中使用此为 源代码

一款抢答器 界面友好 功能完善 支持断开重连 可在娱乐竞赛中使用此为 源代码
https://www.eeworm.com/dl/648/431256.html
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VHDL/FPGA/Verilog VHDL基础 数据对象 抢答器 适合新手

VHDL基础 数据对象 抢答器 适合新手
https://www.eeworm.com/dl/663/432982.html
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单片机开发 51单片机实现抢答器

51单片机实现抢答器,已经在89ST52为微处理器的开发板上运行通过了
https://www.eeworm.com/dl/648/433704.html
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VHDL/FPGA/Verilog 用verilog编写的抢答器

用verilog编写的抢答器,当主持人宣布“开始比赛”,系统初始化,选手进入“抢答状态”。当某一选手首先按下抢答开关时,相应的指示灯亮,此时抢答器不再接受其他输入信号。电路具有累计分控制(分别用4个4位选手的积分——十六进制数),由主持人控制“加分”。“加分”加分完毕,开始下一轮抢答。电路还可以设有回答问 ...
https://www.eeworm.com/dl/663/435859.html
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VHDL/FPGA/Verilog 基于VHDL的数字竞赛抢答器的设计及其仿真

基于VHDL的数字竞赛抢答器的设计及其仿真
https://www.eeworm.com/dl/663/438068.html
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单片机开发 51单片机写的抢答器,注释很详细,适全初学单片机的人.

51单片机写的抢答器,注释很详细,适全初学单片机的人.
https://www.eeworm.com/dl/648/453173.html
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单片机开发 直接烧写进单片机即可按四个独立按键 分别代表4路抢答器按键

直接烧写进单片机即可按四个独立按键 分别代表4路抢答器按键
https://www.eeworm.com/dl/648/455068.html
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单片机开发 四路抢答器perteus电路仿真,由四个抢答按钮和一个主持人清除按钮组成

四路抢答器perteus电路仿真,由四个抢答按钮和一个主持人清除按钮组成
https://www.eeworm.com/dl/648/457067.html
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