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总线时钟 的查询结果
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可编程逻辑 FPGA全局时钟约束(Xilinx)
FPGA全局时钟约束(Xilinx)
可编程逻辑 HDLC协议RS485总线控制器的FPGA实现
介绍了HDLC协议RS485总线控制器的FPGA实现
可编程逻辑 WP370 -采用智能时钟门控技术降低动态开关功耗
 
赛灵思推出业界首款自动化精细粒度时钟门控解决方案，该解决方案可将 Virtex®-6 和 Spartan®-6 FPGA 设计方案的动态功耗降低高达 30%。赛灵思智能时钟门控优化可自动应用于整个设计，既无需在设计流程中添加更多新的工具或步骤，又不会改变现有逻辑或时钟，从而避免设计修改。此外，在大多数情况下 ...
可编程逻辑 基于FPGA的时钟跟踪环路的设计
提出了一种基于FPGA的时钟跟踪环路的设计方案,该方案简化了时钟跟踪环路的结构,降低了时钟调整电路的复杂度。实际电路测试结果表明,该方案能够使接收机时钟快速准确地跟踪发射机时钟的变化,且时钟抖动小、稳准度高、工作稳定可靠。 ...
可编程逻辑 Xilinx FPGA全局时钟资源的使用方法
目前，大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求，一般在FPGA设计中采用全局时钟资源驱动设计的主时钟，以达到最低的时钟抖动和延迟。 FPGA全局时钟资源一般使用全铜层工艺实现，并设计了专用时钟缓冲与驱动结构 ...
可编程逻辑 高速电路传输线效应分析与处理
随着系统设计复杂性和集成度的大规模提高，电子系统设计师们正在从事100MHZ以上的电路设计，总线的工作频率也已经达到或者超过50MHZ，有一大部分甚至超过100MHZ。目前约80% 的设计的时钟频率超过50MHz，将近50% 以上的设计主频超过120MHz，有20%甚至超过500M。当系统工作在50MHz时，将产生传输线效应和信号的完整性问题；而 ...
可编程逻辑 可编程安全系统、安全总线系统
可编程安全系统，安全总线系统模块化安全继电器-PNOZMULTI基础单元，输出扩展模块，输入扩展模块，速度监视模块，通讯扩避展模块等内容。
可编程逻辑 基于GAL的VME总线接口电路及程序设计
根据VME总线规范和协议要求,基于GAL芯片进行了VME总线地址译码、数据读写及中断控制接口电路的设计,完成了电路板设计和研制,试验研究表明其功能满足要求,文中所提出的设计思路方法合理可行。
可编程逻辑 通用阵列逻辑GAL实现基本门电路的设计
通用阵列逻辑GAL实现基本门电路的设计
一、实验目的
1.了解GAL22V10的结构及其应用；
2.掌握GAL器件的设计原则和一般格式；
3.学会使用VHDL语言进行可编程逻辑器件的逻辑设计；
4.掌握通用阵列逻辑GAL的编程、下载、验证功能的全部过程。
二、实验原理
1. 通用阵列逻辑GAL22V10
通用阵列逻辑GAL是由可编程的与阵列、固定（ ...
可编程逻辑 用GAL配合ISA总线模拟I2C总线时序实现对FI1256M
FI1256MK2是被广泛应用的电视信号前端处理器,可使用I2C总线对其进行编程控制。当用在计算机扩展板中时,可由计算机总线通过硬件电路模拟I2C总线的时序。文章给出了用可编程逻辑器件GAL配合ISA总线模拟I2C时序来对RI1256MK2进行编程控制的方法。 ...