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强度计 的查询结果
VHDL/FPGA/Verilog 基于高速串行BCD 码除法的数字频率计的设计
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VHDL/FPGA/Verilog 自己做的FPGA下的频率计模块化设计 附有完整的程序和仿真图纸
自己做的FPGA下的频率计模块化设计 附有完整的程序和仿真图纸
其他行业 神经网络用于X荧光分析的源码。输入元素峰的强度
神经网络用于X荧光分析的源码。输入元素峰的强度，得到含量的学习过程。
单片机开发 水位计程序(PIC16F887)24路开关量读状态口
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VHDL/FPGA/Verilog 这是我课程设计做的数字频率计的设计
这是我课程设计做的数字频率计的设计，不知道会不会太简单或者重复了。
单片机开发 基于51单片机设计的用1602 显示数字钟 频率计 歌曲
基于51单片机设计的用1602 显示数字钟 频率计 歌曲
单片机开发 简单档位计,可根据需要改编成计数器或其它需测速显示设备上.
简单档位计,可根据需要改编成计数器或其它需测速显示设备上.
其他 该程序实现一个频率计
该程序实现一个频率计，测量范围：1-49999999赫兹，用8为数码管扫描显示出被测信号的频率。
INT_DIV模块用于对系统的频率进行分频，此模块的输出信号为被测信号的频率，可以自己设定分频系数，验证频率计的功能，实际应用中，可去掉此模块，直接把待测信号加到CLKCIN端即可。
MYPINLVJI模块是实现频率计的主程序，对系统时 ...