搜索结果
找到约 5,276 项符合
异步时钟 的查询结果
按分类筛选
单片机编程 单片机应用技术选编9
单片机应用技术选编(9) 目录 第一章 专题论述1.1 集成电路进入片上系统时代(2)1.2 系统集成芯片综述(10)1.3 Java嵌入技术综述(18)1.4 Java的线程机制(23)1.5 嵌入式系统中的JTAG接口编程技术(29)1.6 EPAC器件技术概述及应用(37)1.7 VHDL设计中电路简化问题的探讨(42)1.8 8031芯片主要模块的VHDL描述与仿真(48)1.9 ISP技术在 ...
单片机编程 PIC系列单片机手册
PIC系列单片机手册
第1 章 简介 1-1简介 ................................................................................................................................................................. 1-2本手册的宗旨 .................................................................................... ...
教程资料 FPGA用VHDL语言编写24小时时钟
简单明了的VHDL程序实现24小时计时时钟！
教程资料 EDA原理及VHDL实现（何宾教授）
第1章 数字系统EDA设计概论
第2章 可编程逻辑器件设计方法
第3章 VHDL语言基础
第4章 数字逻辑单元设计
第5章 数字系统高级设计技术（*）
第6章 基于HDL设计输入
第7章 基于原理图设计输入
第8章 设计综合和行为仿真
第9章 设计实现和时序仿真
第10章 设计下 ...
教程资料 FPGA全局时钟约束(Xilinx)
FPGA全局时钟约束(Xilinx)
教程资料 WP370 -采用智能时钟门控技术降低动态开关功耗
 
赛灵思推出业界首款自动化精细粒度时钟门控解决方案，该解决方案可将 Virtex®-6 和 Spartan®-6 FPGA 设计方案的动态功耗降低高达 30%。赛灵思智能时钟门控优化可自动应用于整个设计，既无需在设计流程中添加更多新的工具或步骤，又不会改变现有逻辑或时钟，从而避免设计修改。此外，在大多数情况下 ...
教程资料 基于FPGA的时钟跟踪环路的设计
提出了一种基于FPGA的时钟跟踪环路的设计方案,该方案简化了时钟跟踪环路的结构,降低了时钟调整电路的复杂度。实际电路测试结果表明,该方案能够使接收机时钟快速准确地跟踪发射机时钟的变化,且时钟抖动小、稳准度高、工作稳定可靠。 ...
教程资料 Xilinx FPGA全局时钟资源的使用方法
目前，大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求，一般在FPGA设计中采用全局时钟资源驱动设计的主时钟，以达到最低的时钟抖动和延迟。 FPGA全局时钟资源一般使用全铜层工艺实现，并设计了专用时钟缓冲与驱动结构 ...
通信网络 基于RS485的数据通信协议的设计与实现
基于现场可编程门阵列（FPGA），设计了采用RS485标准的数据通信协议。其中，高速信号接收，采用同步485通信协议，高速接口包括时钟和数据两个信号，时钟速率3.6864 MHz，利用同步时钟上升沿检测数据。低速信号接收采用异步485通信协议，波特率115.2 kbps，每字节1个起始位，8个数据位，1个截止位。针对高速数据接收时的情况 ...