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教程资料  很好的几个FPGA工程设计实例，Verilog编写

很好的几个FPGA工程，对提高FPGA设计有一定的帮助（注：代码为Verilog编写）。

https://www.eeworm.com/dl/fpga/doc/18159.html

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教程资料  在文件夹YL2440_CPLD中有做好的CPLD工程

在文件夹YL2440_CPLD中有做好的CPLD工程,请用Xilinx ISE 6.2打开.

https://www.eeworm.com/dl/Protel/doc/18345.html

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教程资料  FPGA输出数据的时频域分析GUI界面

FPGA输出数据的时频域分析GUI界面，\r\n可观察信号的时域频域波形，星座图眼图等特性

https://www.eeworm.com/dl/fpga/doc/18384.html

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教程资料  fpga的静态分析

fpga的静态分析，很不错，只是我自己也没有弄的十分明白

https://www.eeworm.com/dl/fpga/doc/18407.html

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教程资料  FPGA时钟分析

FPGA时钟分析，包括门控时钟与时钟偏仪分析，逻辑设计时钟分析，毛刺分析．

https://www.eeworm.com/dl/fpga/doc/18456.html

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教程资料  采用按时间抽选的基4原位算法和坐标旋转数字式计算机（CORDIC）算法实现了一个FFT实时谱分析系统

采用按时间抽选的基4原位算法和坐标旋转数字式计算机（CORDIC）算法实现了一个FFT实时谱分析系统。整个设计采用流水线工作方式，保证了系统的速度，避免了瓶劲的出现；整个系统采用FPGA实现，实验表明，该系统既有DSP器件实现的灵活性又有专用FFT芯片实现的高速数据吞吐能力，可以广泛地应用于数字信号处理的各个领域。 ...

https://www.eeworm.com/dl/fpga/doc/18553.html

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教程资料  基于FPGA的直接数字合成器的设计与分析的代码程序,代码格式为VHDL

基于FPGA的直接数字合成器的设计与分析的代码程序,代码格式为VHDL

https://www.eeworm.com/dl/fpga/doc/18599.html

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教程资料  该工程文件实现ARM系统中CPLD的逻辑工作

该工程文件实现ARM系统中CPLD的逻辑工作，起到外围资源的逻辑地址译码功能

https://www.eeworm.com/dl/Protel/doc/18754.html

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教程资料  Proteus(海神)的ISIS是一款Labcenter出品的电路分析实物仿真系统

Proteus(海神)的ISIS是一款Labcenter出品的电路分析实物仿真系统，可仿真各种电路和IC，并支持单片机，元件库齐全，使用方便，是不可多得的专业的单片机软件仿真系统。\r\n

https://www.eeworm.com/dl/proteus/doc/19090.html

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教程资料  系统的介绍Proteus ISIS（英国Labcenter公司开发的电路分析与实物仿真软件。）

系统的介绍Proteus ISIS（英国Labcenter公司开发的电路分析与实物仿真软件。）

https://www.eeworm.com/dl/proteus/doc/19199.html

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