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小数分频器 的查询结果
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编译器/解释器 这是一个用VHDL语言写的分频程序,可用得着
这是一个用VHDL语言写的分频程序,可用得着
VHDL/FPGA/Verilog VHDL实现50％占空比。并且是奇数分频。
VHDL实现50％占空比。并且是奇数分频。
VHDL/FPGA/Verilog 奇数分频和倍频
奇数分频和倍频，只需修改参数就可以实现较难得基数分频和倍频
其他 如何给时钟倍频或者分频
如何给时钟倍频或者分频，以及altera提供的IP核使用方法
多国语言处理 lucene.net 2.0的中文分词器
lucene.net 2.0的中文分词器，采用最大向前匹配算法，附上源代码和lucene.net.dll，希望这方面有兴趣的互相交流一下。
VHDL/FPGA/Verilog CPLD_EPM7064程序,运用计数器实现的分频程序,VHDL
CPLD_EPM7064程序,运用计数器实现的分频程序,VHDL
VHDL/FPGA/Verilog VHDL任意整数分频程序
VHDL任意整数分频程序，只要讲n换成需要的数字就可以了！
嵌入式/单片机编程 时钟分频电路实现精讲(19 pages)——意法半导体
时钟分频电路实现精讲(19 pages)——意法半导体
数据结构 了解减法分频电路的设计。 （2）内容：分析例2.8程序的原理
了解减法分频电路的设计。
（2）内容：分析例2.8程序的原理，给出其仿真结果，说明语句的功能。可以改变程序中的分频比。引脚锁定可参考图2.9。
（3）说明：将CLK2的跳线冒连在2Hz上 。LED1指示输入频率，LED2分频后的结果。可以看到LED1每闪烁6下，LED2闪烁一下，因为是6分频电路。 ...
汇编语言 对任意始终进行精确的5分频处理,而且没有毛刺,效果很好.
对任意始终进行精确的5分频处理,而且没有毛刺,效果很好.