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教程资料  用CPLD设计实现一个具有预置数的数字钟

本设计要实现一个具有预置数的数字钟的设计,具体要求如下:\r\n1. 正确显示年、月、日 \r\n2. 正确显示时、分、秒 \r\n3. 具有校时,整点报时和秒表功能 \r\n4. 进行系统模拟仿真和下载编程实验,验证系统的正确性 \r\n

https://www.eeworm.com/dl/fpga/doc/18549.html

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教程资料  数字信号处理在FPGA上实现的经典教材

数字信号处理在FPGA上实现的经典教材，本书详细介绍了数字信号处理的算法，以及其在FPGA上用硬件描述语言实现

https://www.eeworm.com/dl/fpga/doc/18560.html

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教程资料  数字信号处理的FPGA实现(第二版）书的源代码。

数字信号处理的FPGA实现(第二版）书的源代码。

https://www.eeworm.com/dl/fpga/doc/18565.html

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教程资料  一种用CPLD设计GPS数字通道相关器中C／A码产生嚣的方法

摘要本文介绍了一种用CPLD设计GPS数字通道相关器中C／A码产生嚣的方法，详细分析了设计原理并给出了相应的仿真结果．这种设计方法已在我们研制的GPS，GLONASS兼容机中得到实际应用。

https://www.eeworm.com/dl/Protel/doc/18587.html

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教程资料  《FPGA数字电子系统设计与开发实例导航》的配套光盘

《FPGA数字电子系统设计与开发实例导航》的配套光盘，Verilog编写，USB、I2C、MAC的接口设计

https://www.eeworm.com/dl/fpga/doc/18590.html

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教程资料  EDA 实验原代码包括数字脉冲触发器和交通灯等

EDA 实验原代码包括数字脉冲触发器和交通灯等

https://www.eeworm.com/dl/fpga/doc/18591.html

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教程资料  基于FPGA的直接数字合成器的设计与分析的代码程序,代码格式为VHDL

基于FPGA的直接数字合成器的设计与分析的代码程序,代码格式为VHDL

https://www.eeworm.com/dl/fpga/doc/18599.html

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教程资料  ＦＰＧＡ数字钟的设计

ＦＰＧＡ数字钟的设计，用VHDL语言编程，max+plus仿真，可在实际电路中验证

https://www.eeworm.com/dl/fpga/doc/18614.html

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教程资料  数字设计——CPLD应用与VHDL源文件

数字设计——CPLD应用与VHDL源文件，很不错的，希望能对大家有用

https://www.eeworm.com/dl/Protel/doc/18632.html

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教程资料  CPLD数字电路设计硬件描述语言一例

CPLD数字电路设计硬件描述语言一例+一本经典教材，入门专用

https://www.eeworm.com/dl/Protel/doc/18684.html

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