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教程资料 Altera FPGA与CPLD的外部处理器连接方式及编程。

Altera FPGA与CPLD的外部处理器连接方式及编程。
https://www.eeworm.com/dl/fpga/doc/18309.html
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教程资料 多个Verilog和vhdl程序例子

多个Verilog和vhdl程序例子,可以作为初学者参考实例,按照电路结构写出HDL代码
https://www.eeworm.com/dl/fpga/doc/18335.html
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教程资料 MIL-STD一1553B是一种集中控制式、时分指令/响应型多路串行数据总线标

MIL-STD一1553B是一种集中控制式、时分指令/响应型多路串行数据总线标\r\n准,具有高可靠性和灵活性,已经成为现代航空机载系统设备互联的最有效的解\r\n决方案,广泛的应用于飞机、舰船、坦克等武器平台上,并且越来越多的应用到\r\n民用领域。完成1553B总线数据传输功能的关键部件是总线接口芯片11][41。\r\n在对M几STD一 ...
https://www.eeworm.com/dl/fpga/doc/18363.html
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教程资料 一种基于CPLD和多处理器结构的控制网络节点设计方案

节点是网络系统的基本控制单元,论文提出了一种基于CPLD和多处理器结构的控制网络节点设计方案,它能够提高单节点并行处理能力,其模块化结构增强了节点的可靠性。
https://www.eeworm.com/dl/Protel/doc/18504.html
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教程资料 Altera FPGA的特殊管脚的连接(中文)

AlteraFPGA的特殊管脚的连接(中文)
https://www.eeworm.com/dl/fpga/doc/18564.html
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教程资料 dsp与cpld的连接原理图

dsp与cpld的连接原理图,华绑的哦!
https://www.eeworm.com/dl/Protel/doc/18585.html
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教程资料 基于CPLD的多功能信号发生器设计

基于CPLD的多功能信号发生器设计.PDF
https://www.eeworm.com/dl/Protel/doc/18600.html
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教程资料 Xilinx公司的FPGA下载电路连接原理图

Xilinx公司的FPGA下载电路连接原理图,对初学EDA者应该有所帮助。
https://www.eeworm.com/dl/fpga/doc/18640.html
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教程资料 大型设计中FPGA的多时钟设计策略,很详细的描述了在FPGA设计中时钟设计的方法

大型设计中FPGA的多时钟设计策略,很详细的描述了在FPGA设计中时钟设计的方法
https://www.eeworm.com/dl/fpga/doc/18690.html
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教程资料 用CPLD控制LED、数码管的显示源代码

工作原理:\r\n 脉冲输入,记录30个脉冲的间隔时间(总时间),LED显示出来,牵涉到数码管的轮流点亮,以及LED的码。输入端口一定要用个\r\n74LS14整一下,图上没有。数码管使用共阴数码管。MAXPLUS编译。\r\n测试时将光电门的信号端一块连接到J2口的第三管脚,同时第一管脚为地,应该与光电门的地连接(共地)。\r\n开始测 ...
https://www.eeworm.com/dl/Protel/doc/18753.html
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