搜索：同步降压控制器

教程资料  一种以CPLD为核心、以VHDL为开发工具的时间控制器

本文介绍一种以CPLD[1]为核心、以VHDL[2]为开发工具的时间控制器，该控制器不仅具有时间功能，而且具有定时器功能，能在00：00～23：59之间任意设定开启时间和关闭时间，其设置方便、灵活，广泛应用于路灯、广告灯箱、霓虹灯等处的定时控制。 ...

https://www.eeworm.com/dl/Protel/doc/17977.html

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教程资料  针对嵌入式系统的底层网络接口给出了一种由FPGA实现的以太网控制器的设计方法

针对嵌入式系统的底层网络接口给出了一种由FPGA实现的以太网控制器的设计方法．该控制器能支持10Mbps和100Mbps的传输速率以及半双工和全双工模式，同时可提供MII接口，可并通过外接以太网物理层（PHY）芯片来实现网络接入\r\n

https://www.eeworm.com/dl/fpga/doc/18042.html

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教程资料  FPGA视频控制器设计,FED驱动控制系统的研制与FPGA设计

FPGA视频控制器设计,FED驱动控制系统的研制与FPGA设计\r\n

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教程资料  基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究

针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA) 来实现各模块的逻辑功能。最终实现了对L ED 显示屏的控制,并且一块主控制板最大限度的控制了256 ×128 个像素点,基于相同条件,比静态内存控制的 ...

https://www.eeworm.com/dl/fpga/doc/18155.html

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教程资料  基于CPLD的双屏结构液晶控制器的研究与设计

基于CPLD的双屏结构液晶控制器的研究与设计作者：黄丽薇.doc

https://www.eeworm.com/dl/Protel/doc/18238.html

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教程资料  FPGA异步时钟设计中的同步策略

FPGA异步时钟设计中的同步策略，需要

https://www.eeworm.com/dl/fpga/doc/18258.html

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教程资料  基于FPGA的高分辨率VGA显示控制器的设计

基于FPGA的高分辨率VGA显示控制器的设计

https://www.eeworm.com/dl/fpga/doc/18264.html

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教程资料  altera fpga 基于vhdl,实现vga的同步block

altera fpga 基于vhdl,实现vga的同步block.

https://www.eeworm.com/dl/fpga/doc/18337.html

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教程资料  基于FPGA的新型数据位同步时钟提取(CDR)实现方法

基于FPGA的新型数据位同步时钟提取(CDR)实现方法

https://www.eeworm.com/dl/fpga/doc/18408.html

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教程资料  基于FPGA液晶控制器设计与实现（VHDL语言）

基于FPGA液晶控制器设计与实现，采用VHDL硬件描述语言。

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