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找到约 153 项符合 叠加 的查询结果

人工智能/神经网络 串音误差检测

串音误差检测,利用ica算法实现盲信号分离,以及检测输入信号叠加分离后的误差
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软件工程 设计模式——访问者模式 Visitor模式允许我们在不改动原有结构的基础之上不断增加新的功能。 ICumulation接口定义了方法Cumulate()

设计模式——访问者模式 Visitor模式允许我们在不改动原有结构的基础之上不断增加新的功能。 ICumulation接口定义了方法Cumulate(),旨在计算1+2+……+n,有两种不同的实现方法,一个是一般的叠加算法GeneralArithmetic,一个是高斯算法GaoSiArithmetic。 因为某种原因,系统需要添加求平均值的功能,还有计算1到n的 ...
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VHDL/FPGA/Verilog vhdl波形发生程序.实现4种常见波形正弦、三角、锯齿、方波(A、B)的频率、幅度可控输出(方波 A的占空比也是可控的)

vhdl波形发生程序.实现4种常见波形正弦、三角、锯齿、方波(A、B)的频率、幅度可控输出(方波 A的占空比也是可控的),可以存储任意波形特征数据并能重现该波形,还可完成 各种波形的线形叠加输出。
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书籍源码 DmoVideoWatermark 这是一个DMO组件

DmoVideoWatermark 这是一个DMO组件,演示了Windows Media支持的水印叠加功能。
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其他 数字信号处理的应用之一是从含有加性噪声的信号中去除噪声。现有被噪声污染的信号x[k]=s[k]+d[k],式中: 为原始信号d[k]为均匀分布的白噪声。 (1)分别产生50点的序列s[k]和白噪声序

数字信号处理的应用之一是从含有加性噪声的信号中去除噪声。现有被噪声污染的信号x[k]=s[k]+d[k],式中: 为原始信号d[k]为均匀分布的白噪声。 (1)分别产生50点的序列s[k]和白噪声序列d[k],将二者叠加生成x[k],并在同一张图上绘出x0[k],d[k]和x[k]的序列波形。 (2)均值滤波可以有效去除叠加在低频信号上的噪声。已知3点 ...
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matlab例程 该函数仿真CDMA系统的信道

该函数仿真CDMA系统的信道,在输入所需用户序列和其他干扰用户序列后在信号上叠加高斯白噪声,干扰用户多径干扰和所需用户的多径干扰和衰落。并根据输入延时曲线产生信道延时,输出mul_fad_sequence为信道信号输出,max_delay为信道最大延迟,fade_sign为瑞利信道中最大幅度分量的衰落量 mpath_amp为信道多径的幅度因子 ...
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单片机开发 8位单片机很多地方需要随机数

8位单片机很多地方需要随机数,比如游戏的洗牌,可在timer中取数,但是随机数质 量不高。随机数是一个既简单又复杂的问题,这里的例子使用了众所周知的线性叠加法,没 有完美的方法产生随机数,不过线性叠加法是一个合适的方法,彻底解决8位机随机数的问 题。 ...
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其他行业 C语言写的一个DS1302实时时钟程序

C语言写的一个DS1302实时时钟程序,这个很多时候应用在视频叠加系统。
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VHDL/FPGA/Verilog FPGA上的VERILOG语言编程。通过查找表实现直接数字频率合成。在主控部分通过键盘选择正弦波

FPGA上的VERILOG语言编程。通过查找表实现直接数字频率合成。在主控部分通过键盘选择正弦波,方波,三角波,斜波,以及四种波形的任意两种的叠加,以及四种波形的叠加;通过控制频率控制字C的大小,以控制输出波形频率,实现1Hz的微调;通过地址变换实现波形相位256级可调;通过DAC0832使波形幅值256级可调;通过FPGA内部RA ...
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单片机开发 先画一个实心圆

先画一个实心圆,然后再画一条横线,再在实心圆上叠加显 // 显示汉字:"凌阳科技",最后实现向上滚屏 // 涉及的库: CMacro1016.lib // 组成文件: main.c/SPLC501User.c/Chinese_Table.c // SPLC501Driver_IO.asm/DataOSforLCD.asm // SPLC501User.h/Chinese_Table.h // SPLC501Driver_IO.inc // // 硬件连接 ...
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