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找到约 20,296 项符合 反相器联 的查询结果

单片机开发 一个生成反相CRC-CCITT校验码表的单片机C程序

一个生成反相CRC-CCITT校验码表的单片机C程序,反相CRC-CCITT= 0x8408,开发环境为Keil C51
https://www.eeworm.com/dl/648/185239.html
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系统设计方案 本文在阐明反相对称调制(PISM)原理的基础上

本文在阐明反相对称调制(PISM)原理的基础上,结合曼彻斯特码的结构特点,给出了一种基于PISM原理的曼彻斯特码解码系统,并对其抗噪声性能进行了理论分析,揭示了曼彻斯特码潜在的抗噪声性能。
https://www.eeworm.com/dl/678/187968.html
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VHDL/FPGA/Verilog 数字边沿鉴相器 verilog源程序

数字边沿鉴相器 verilog源程序
https://www.eeworm.com/dl/663/200835.html
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其他书籍 《黑客调试技术揭密》是帮助应用程序员和系统程序员理解调试过程的指南,揭示了各种调试器的实用使用技巧,说明了如何操作调试器以及如何克服障碍和修复调试器,介绍了黑客利用调试器和反汇编器来寻找程序弱点和实施

《黑客调试技术揭密》是帮助应用程序员和系统程序员理解调试过程的指南,揭示了各种调试器的实用使用技巧,说明了如何操作调试器以及如何克服障碍和修复调试器,介绍了黑客利用调试器和反汇编器来寻找程序弱点和实施攻击的方法 ...
https://www.eeworm.com/dl/542/218378.html
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RFID编程 DPLL由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K

DPLL由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低. ...
https://www.eeworm.com/dl/697/248673.html
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微处理器开发 ch03目录下: disasm.tgz :作者改写的反汇编器,可以输出比较容易接受的汇编格式。 simpleboot.tgz: 作者编写的简单boot代码 ch04目录下: gba

ch03目录下: disasm.tgz :作者改写的反汇编器,可以输出比较容易接受的汇编格式。 simpleboot.tgz: 作者编写的简单boot代码 ch04目录下: gba_ucos.tgz : 作者移植的可运行在GBA(或者模拟器)上的uC/OS-II代码 ch05目录下: znet.tgz : 作者在uC/OS-II上实现的tcp/ip协议实现代码 ch09目录下: font.c 字体显示和变 ...
https://www.eeworm.com/dl/655/261369.html
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汇编语言 PE Monitor是一个小调试器和反汇编器

PE Monitor是一个小调试器和反汇编器,用来设置断点在指定的API上。这样,可以通过PE Monitor来监控我们需要的PE程序的运行时信息。
https://www.eeworm.com/dl/644/282666.html
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单片机开发 Avr系列单片机反汇编器源代码.GCC编译

Avr系列单片机反汇编器源代码.GCC编译
https://www.eeworm.com/dl/648/292372.html
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编译器/解释器 一个反汇编器源码 一个反汇编器源码

一个反汇编器源码 一个反汇编器源码
https://www.eeworm.com/dl/628/304359.html
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VHDL/FPGA/Verilog verilog编写基于fpga的鉴相器模块

verilog编写基于fpga的鉴相器模块
https://www.eeworm.com/dl/663/330800.html
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