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双轴加速度计 的查询结果
Java编程 要求环境 是JDK1.5才能运行 ScreenTest.jar文件是可以直接双击运行的 要退出很容易,只要按一下小键盘上的0就可以退出了
要求环境 是JDK1.5才能运行
ScreenTest.jar文件是可以直接双击运行的
要退出很容易,只要按一下小键盘上的0就可以退出了
中间件编程 支持键盘双击事件的C程序设计,相信会对大家的C语言编程有应用价值
支持键盘双击事件的C程序设计,相信会对大家的C语言编程有应用价值
其他 产生高斯脉冲的前15阶导函数。该函数的输入参数为：矢量t定义时间轴；高斯脉冲导函数的阶数k
产生高斯脉冲的前15阶导函数。该函数的输入参数为：矢量t定义时间轴；高斯脉冲导函数的阶数k，取值范围[1，15]
技术管理 110kV同杆双回输电线路的雷电性能,通过应用同塔双回线路雷电性能的计算研究表明
110kV同杆双回输电线路的雷电性能,通过应用同塔双回线路雷电性能的计算研究表明，该方式具有较好的雷电性能。通过珠海供电局工程中的试用，已初步验证了其效果，可继续积累运行经验
单片机开发 这是本人初学C51时编写并成功完成调试的第一个较大的C程序,里面包含有双单片机通信键盘描扫电子音乐等内容
这是本人初学C51时编写并成功完成调试的第一个较大的C程序,里面包含有双单片机通信\键盘描扫\电子音乐等内容
VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.4 脉冲频率的测量与显示 9.4.1 脉冲频率的测量原理 9.4.2 频率计的工作原理 9.4.3 频率测量模块的设计与实现
基于Verilog-HDL的硬件电路的实现
9.4 脉冲频率的测量与显示
9.4.1 脉冲频率的测量原理
9.4.2 频率计的工作原理
9.4.3 频率测量模块的设计与实现
9.4.4 while循环语句的使用方法
9.4.5 门控信号发生模块的设计与实现
9.4.6 频率计的Verilog-HDL描述
9.4.7 频率计的硬件实现 ...
VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.5 脉冲周期的测量与显示 9.5.1 脉冲周期的测量原理 9.5.2 周期计的工作原理 9.5.3 周期测量模块的设计与实现
基于Verilog-HDL的硬件电路的实现
9.5 脉冲周期的测量与显示
9.5.1 脉冲周期的测量原理
9.5.2 周期计的工作原理
9.5.3 周期测量模块的设计与实现
9.5.4 forever循环语句的使用方法
9.5.5 disable禁止语句的使用方法
9.5.6 时标信号发生模块的设计与实现
9.5.7 周期计的Verilog-HDL描述 ...
数据结构 用双链表实现的踢人问题
用双链表实现的踢人问题，一群人按顺序排成一圈，从第一个人开始每隔M人踢出一个人，如此循环，求已知最后n个被踢出的，求M
VHDL/FPGA/Verilog 这是eda初学者可以借鉴的两个关于电子频率计的VHDL设计实例
这是eda初学者可以借鉴的两个关于电子频率计的VHDL设计实例
单片机开发 我暑假课程设计做的题目,电子频率计的设计 包括源码和电路图 还有实物照片
我暑假课程设计做的题目,电子频率计的设计 包括源码和电路图 还有实物照片