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单片机编程  STM32的TIM1_CC1触发双ADC作同步规则转换

TIM1_CC1触发双ADC作同步规则转换，DMA存储转换结果。请使用\MDK-ARM(uV4)下的Keil工程文件，已调试通过。

https://www.eeworm.com/dl/502/17136.html

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设计相关  双电源切换电路

可以实现外部或电池双供电的参考设计，用于安全控制行业

https://www.eeworm.com/dl/513/17282.html

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教程资料  基于FPGA数字频率计的实现

基于FPGA数字频率计的实现，文中有所有的源代码，仅供参考。

https://www.eeworm.com/dl/fpga/doc/17478.html

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教程资料  基FPGA Cyclone II_EP2C5 EP2C8的频率计

基FPGA Cyclone II_EP2C5 EP2C8的频率计

https://www.eeworm.com/dl/fpga/doc/17480.html

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教程资料  基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计

基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序

https://www.eeworm.com/dl/fpga/doc/17512.html

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教程资料  FPGA设计频率计全套资料

FPGA设计频率计全套资料，我希望对大家啊好似有用的

https://www.eeworm.com/dl/fpga/doc/17565.html

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教程资料  异步FIFO是用来适配不同异步FIFO采用了格雷（GRAY）变换技术和双端口RAM实现了不同时钟域之间的数据无损传输

异步FIFO是用来适配不同时钟域之间的相位差和频率飘移的重要模块。本文设计的异步FIFO采用了格雷（GRAY）变换技术和双端口RAM实现了不同时钟域之间的数据无损传输。该结构利用了GRAY变换的特点，使得整个系统可靠性高和抗干扰能力强，系统可以工作在读写时钟频率漂移达到正负300PPM的恶劣环境。并且由于采用了模块化结构， ...

https://www.eeworm.com/dl/fpga/doc/17596.html

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教程资料  MAXPLUS_环境下的频率计设计及其完善

MAXPLUS_环境下的频率计设计及其完善

https://www.eeworm.com/dl/Protel/doc/17671.html

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教程资料  在FPGA内实现双口RAM

这样就可以在FPGA内实现双口RAM了...

https://www.eeworm.com/dl/fpga/doc/17801.html

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教程资料  keil和Proteus设计的C51频率计代码

一个自己用keil和Proteus设计的C51频率计代码,与大家一同分享!

https://www.eeworm.com/dl/proteus/doc/18014.html

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