搜索：十进制转十六进制

汇编语言  汇编设计乘法指令用十六位成一十六位结果三十而位

汇编设计乘法指令用十六位成一十六位结果三十而位

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VHDL/FPGA/Verilog 本文为用vhdl语言编写的2进制到10进制转换的程序

本文为用vhdl语言编写的2进制到10进制转换的程序，为doc格式，使用前复制于maxplus等相应软件中使用。

https://www.eeworm.com/dl/663/388760.html

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编译器/解释器  一个多种进制互相转化的很强大的软件

一个多种进制互相转化的很强大的软件

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VHDL/FPGA/Verilog 基于CPLD/FPGA的十六位乘法器的VHDL实现

基于CPLD/FPGA的十六位乘法器的VHDL实现

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数据结构  通过堆栈的简单应用实现10进制到任意进制之间的转换

通过堆栈的简单应用实现10进制到任意进制之间的转换

https://www.eeworm.com/dl/654/392819.html

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数据结构  数据结构课程设计数值进制转换学生成绩管理

数据结构课程设计数值进制转换学生成绩管理

https://www.eeworm.com/dl/654/394603.html

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VHDL/FPGA/Verilog 此程序实现的是任意进制的分频进制的输入是任意选择的

此程序实现的是任意进制的分频进制的输入是任意选择的

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其他  计算机组成原理课程设计.模型机设计四大类指令共十六条

计算机组成原理课程设计.模型机设计四大类指令共十六条，其中包括算术逻辑指令、I／O指令、访问存储器及转移指令和停机指令。

https://www.eeworm.com/dl/534/397227.html

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其他  多进制输出。输入一个非负的10进制数和一个相应的数字

多进制输出。输入一个非负的10进制数和一个相应的数字，转化成该进制

https://www.eeworm.com/dl/534/397956.html

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其他  设计一个能进行时、分、秒计时的十二小时制或二十四小时制的数字钟

设计一个能进行时、分、秒计时的十二小时制或二十四小时制的数字钟，并具有定时与闹钟功能，能在设定的时间发出闹铃音，能非常方便地对小时、分钟和秒进行手动调节以校准时间，每逢整点，产生报时音报时。实验平台： 1. 一台PC机； 2. MAX+PLUSII10.1。 Verilog HDL语言实现 ...

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