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其他  用LSFR实现计数功能

用LSFR实现计数功能，可以减少对寄存器和少一个加法器，涉及verilog的人来说

https://www.eeworm.com/dl/534/387959.html

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VHDL/FPGA/Verilog vhdl语言设计频率计

vhdl语言设计频率计，十进制加法器.运用maxplus2运行，

https://www.eeworm.com/dl/663/398133.html

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VHDL/FPGA/Verilog 基于verilog的fir滤波器设计

基于verilog的fir滤波器设计，用的并行结构。在前面基础上加入四级流水（加法器，并行乘法器，乘法结果相加两级），通过验证。

https://www.eeworm.com/dl/663/399117.html

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VHDL/FPGA/Verilog 数字信号处理的fpga实现

数字信号处理的fpga实现，用VHDL编程设计加法器

https://www.eeworm.com/dl/663/404209.html

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VHDL/FPGA/Verilog VHDL编程一百例

VHDL编程一百例，包括加法器、乘法器、移位寄存器、奇偶校验器等。pdf格式的，仅供学习使用

https://www.eeworm.com/dl/663/410040.html

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其他  一些接口电路的Verilog设计

一些接口电路的Verilog设计，主要包括IIC、PS2、矩阵键盘、RS232、还有一些基础试验的源代码如：除法器、多路选择器、加法器、减法器、8位优先编码器等。

https://www.eeworm.com/dl/534/436752.html

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其他  步进电机控制

步进电机控制，直流电机控制，加法器，状态机等等经典的VHDL例子程序。

https://www.eeworm.com/dl/534/450602.html

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单片机开发  1.通过键盘、LCD来进行超低功耗实验 2 在一段时间内

1.通过键盘、LCD来进行超低功耗实验 2 在一段时间内，如果用户没有进行按键操作，系统将进入“睡眠”－－低功耗状态 3 用户按键后，系统从低功耗状态转到正常的工作状态 4 在非低功耗状态下，程序接收键盘按键执行加法器操作(因为键盘和LCD限制不能实现复杂 5 的功能,如乘法、减法、除法等）. ...

https://www.eeworm.com/dl/648/454841.html

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VHDL/FPGA/Verilog 累加器

累加器，一个加法器和一个寄存器构成的累加器，其用途是用于DDS技术的相位累加器

https://www.eeworm.com/dl/663/472557.html

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VHDL/FPGA/Verilog 用verilog设计的FIR滤波器。滤波器需要很快的处理速度

用verilog设计的FIR滤波器。滤波器需要很快的处理速度，所以采用了wallace树算法，超前进位加法器等等

https://www.eeworm.com/dl/663/473392.html

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