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VHDL/FPGA/Verilog 内附多路选择器

内附多路选择器，74系列芯片VHDL源码，加法器，FIR，比较器等大量例子，对初学VHDL语言很有好处。可用maxplus，quartus，synplicity等综合软件进行调试

https://www.eeworm.com/dl/663/137275.html

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VHDL/FPGA/Verilog 内有波形发生器

内有波形发生器，加法器，经典双进程状态机，伪随机熟产生器，相应加法器的测试向量，16×8bit RAM,FIFO,通用RAM等源程序

https://www.eeworm.com/dl/663/141282.html

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VHDL/FPGA/Verilog 这是有关VHDL的相关源代码

这是有关VHDL的相关源代码，有简易CPU、加法器、除法器、计数器等

https://www.eeworm.com/dl/663/145313.html

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VHDL/FPGA/Verilog 【经典设计】VHDL源代码下载～～其中经典的设计有：【自动售货机】、【电子钟】、【红绿灯交通信号系统】、【步进电机定位控制系统】、【直流电机速度控制系统】、【计算器】、【点阵列LED显示控制系统】

【经典设计】VHDL源代码下载～～其中经典的设计有：【自动售货机】、【电子钟】、【红绿灯交通信号系统】、【步进电机定位控制系统】、【直流电机速度控制系统】、【计算器】、【点阵列LED显示控制系统】基本数字逻辑设计有：【锁存器】、【多路选择器】、【三态门】、【双向输入|输出端口】、【内部（缓冲）信号】、【编 ...

https://www.eeworm.com/dl/663/164942.html

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VHDL/FPGA/Verilog verilog源码

verilog源码，可实现两位的加法器，在xillinx foundation 3.1下验证通过

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VHDL/FPGA/Verilog 朋友

朋友，我是Jawen.看到先前上载的一套CPLD开发板的VHDL源码挺受欢迎的，现在就将她的Verilog源码也一并贡献给大家：8位优先编码器,乘法器,多路选择器,二进制转BCD码,加法器,减法器,简单状态机,四位比较器,7段数码管,i2c总线,lcd液晶显示,拨码开关,串口,蜂鸣器,矩阵键盘,跑马灯,交通灯,数字时钟 ...

https://www.eeworm.com/dl/663/190849.html

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书籍源码  100个经典vhdl编程实例

100个经典vhdl编程实例，第1例带控制端口的加法器第2例无控制端口的加法器第3例乘法器第4例比较器第5例二路选择器第6例寄存器第7例移位寄存器第8例综合单元库第9例七值逻辑与基本数据类型第10例函数第11例七值逻辑线或分辨函数第12例转换函数第13例左移函数第14例七值逻辑程序包第15例四输入 ...

https://www.eeworm.com/dl/532/212325.html

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并行计算  数字系统设计这是有关的相关源代码

数字系统设计这是有关的相关源代码，有简易CPU 除法器、计数器等 ...[fpdiv_vhdl.rar] - 四位除法器的vhdl源程序 [vhdl范例.rar] - 最高优先级编码器8位相等比较器三人表决器（三种不同的描述方式）加法器描述 8位总线收发器：74245 （注2）地址译码（for m68008）多路选择器（使 BR> ... ...

https://www.eeworm.com/dl/694/219076.html

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VHDL/FPGA/Verilog 用verlog语言编的一些基础实验,适合于FPGA/CPLD的初学者。内容包括8位优先编码器

用verlog语言编的一些基础实验,适合于FPGA/CPLD的初学者。内容包括8位优先编码器，乘法器，除法器，多路选择器，二进制转BCD码，加法器，减法器等等。

https://www.eeworm.com/dl/663/221711.html

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软件设计/软件工程  10个VHDL程序实例

10个VHDL程序实例，包括加法器，全加器、函数发生器，选择器等。

https://www.eeworm.com/dl/684/227218.html

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