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VHDL/FPGA/Verilog 该程序是基于FPGA的硬件描述语言

该程序是基于FPGA的硬件描述语言，实现的功能是对时钟进行分频，从而产生任意频率的输出时钟。

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其他  时钟产生电路

时钟产生电路，12.5倍分频电路，可以用于参考半分频电路

https://www.eeworm.com/dl/534/492434.html

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VHDL/FPGA/Verilog 简易电子琴

简易电子琴，可以弹奏音乐。本课程设计主要内容是基于VHDL语言并利用数控分频器设计硬件电子琴，利用GW48作为课程开发硬件平台，键1至键8设计为电子琴键。某一个LED显示当前的按键的音节数。

https://www.eeworm.com/dl/663/492700.html

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VHDL/FPGA/Verilog 并串转换器：将并行输入的信号以串行方式输出

并串转换器：将并行输入的信号以串行方式输出，这里要注意需先对时钟进行分频，用得到的低频信号控制时序，有利于观察结果（可以通过L灯观察结果）

https://www.eeworm.com/dl/663/493442.html

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VHDL/FPGA/Verilog FPGA的多路可控脉冲延迟系统.docx

　1&nbsp; 系统功能　　本系统拟定对频率范围在1~50 kHz左右的TTL电平脉冲序列进行多路延迟处理。各路延迟时间分别由单片机动态设定，最大延迟时间为1 ms，最大分辨率为0.15 ns级。　3&nbsp; 方案实现　　系统选用Actel公司的ProASIC3 A3P250芯片实现数字部分。系统时钟由外部50 MHz晶振提供，时钟引脚连接 ...

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技术教程  音响故障维修

电子分频其实是相对于功率分频而言的，功率分频指音频信号经过放大器后输入音箱，通过音响内部的分频器对功率的信号进行分频后，再输出到各个单元。而电子分频先通过电子滤波器将音频信号滤波分出高、中、低后，在经过放大器分别输出到对应的单元上，这样功放就直接驳接扬声单元了 ...

https://www.eeworm.com/dl/506854.html

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第一章、ALTERA QUATUSII 5.0 使用介绍...................................... 3 1. 概述.................................................................. 3 2. QUATUSII 设计过程..................................................... 5 2.1. 建立工程.......................................................... ...

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单片机编程  红外解码程序

/* &nbsp;* _168ZHONGDUAN2.c &nbsp;* &nbsp;* Created: 2014/11/2 15:12:45 &nbsp;* &nbsp;Author: lenovo &nbsp;*/&nbsp; #include <avr/io.h> #include <avr/iom168pa.h> #include <avr/interrupt.h> #include <util/delay.h> #include <avr/eeprom.h> //#include <util/delay_basic.h> //unsigned char const SEGtabl ...

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单片机编程  AVR单片机转速表

/****************************************************************&nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; 外部晶振8M&nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; PA0~3：四位数码管的位选&nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; PB0~7：数码管 ...

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源码  基于verilog的正弦信号发生器

基于verilog正弦信号发生器，实用软件为quartus ii，分频模块有四个

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