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单片机开发  利用两个数码管

利用两个数码管，模拟对时钟信号分频后技术功能，理解数码管的动态显示其中程序中有动态扫描进程；译码进程；数字技术进程三个进程，也可以实现分块实现

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VHDL/FPGA/Verilog 用VHDL实现2

用VHDL实现2，4，8分频设计，经编译，波形仿真成功

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单片机开发  单片机频率计的设计

单片机频率计的设计，利用分步逻辑芯片，对高频信号进行分频，用数据选择器，选择输入信号输入单片机计时处理。有

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VHDL/FPGA/Verilog 给出了数字跑表的源代码

给出了数字跑表的源代码，设计了分频模块，实现了真实的时间计数，通过这个工程的训练，能更好的了解Quartus II数字电路开发的过程。

https://www.eeworm.com/dl/663/374790.html

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VHDL/FPGA/Verilog 根据交通灯控制器的功能与要求

根据交通灯控制器的功能与要求，将其总体电路分为分频器、信号控制器两个模块。

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单片机开发  PWM经过RC滤波产生电压,经过XTR115产生4-20mA电流输出,要点是XTR115的电压输入问题,自身为两线制,+5V输出提供不了较大电流,需要用DCDC,RC滤波采用钽电容和4.7k-4.9k

PWM经过RC滤波产生电压,经过XTR115产生4-20mA电流输出,要点是XTR115的电压输入问题,自身为两线制,+5V输出提供不了较大电流,需要用DCDC,RC滤波采用钽电容和4.7k-4.9k的低温漂电阻能得到较高线形度,PWM输出为AVR单片机16位,模式15,不分频

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VHDL/FPGA/Verilog 设计并调试好一个能产生”梁祝”曲子的音乐发生器

设计并调试好一个能产生”梁祝”曲子的音乐发生器，并用EDA实验开发系统（拟采用的实验芯片的型号可选Altera的MAX7000系列的 EPM7128 CPLD ，FLEX10K系列的EPF10K10LC84-3 FPGA， ACEX1K系列的 EP1K30 FPGA，Xinlinx 的XC9500系列的XC95108 CPLD，Lattice的ispLSI1000系列的1032E CPLD）进行硬件验证。设计思路根据系统 ...

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单片机开发  CONTROL89C51串口控制程序

CONTROL89C51串口控制程序，输入: 波特率分频系数, 波特率分频常数，主机方式: 控制传输-设置USB配置

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其他嵌入式/单片机内容  Holtek单片机源码：此应用示范了使用HT48C10单片机的 16 位定时计数器产生内部中断以实现计时功能。这个应用依靠系统时钟频率作为计时的基准。此处所示的应用使用了 400KHz的系统时钟

Holtek单片机源码：此应用示范了使用HT48C10单片机的 16 位定时计数器产生内部中断以实现计时功能。这个应用依靠系统时钟频率作为计时的基准。此处所示的应用使用了 400KHz的系统时钟，通过内部除四分频产生 100KHz 的定时/计数器时钟。对于一个 16 位的计数器最大计数值为 65536，这将每隔 0.65536 秒产生一个内部中断。但 ...

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单片机开发  本例展示了如何利用外设TIM2来产生四路频率不同的信号。 TIM2时钟设置为36MHz

本例展示了如何利用外设TIM2来产生四路频率不同的信号。 TIM2时钟设置为36MHz，预分频设置为2，使用输出比较-翻转模式（Output Compare Toggle Mode）。 TIM2计数器时钟可表达为：TIM2 counter clock = TIMxCLK / (Prescaler +1) = 12 MHz 设置TIM2_CCR1寄存器值为32768，则CC1更新频率为TIM2计数器时钟频率除以CCR1寄存 ...

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