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VHDL/FPGA/Verilog 一个基于CPLD/FPGA的半整数分频器的设计的文档资料

一个基于CPLD/FPGA的半整数分频器的设计的文档资料

https://www.eeworm.com/dl/663/319864.html

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VHDL/FPGA/Verilog 好的分频器设计程序

好的分频器设计程序，有三个，二分频，八分频随便改，比较实用

https://www.eeworm.com/dl/663/320538.html

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书籍源码  分频计时4.615ms产生中断信息用于GSM中的信息验证

分频计时4.615ms产生中断信息用于GSM中的信息验证，大家可以拿来参考一下

https://www.eeworm.com/dl/532/323985.html

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嵌入式/单片机编程  5分频cpld原理图实现

5分频cpld原理图实现，实现正交编码5分频

https://www.eeworm.com/dl/647/324848.html

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单片机开发  MB1504锁相环芯片的51单片机驱动程序,可以根据需要修改合适的分频值来完成频率合成配置.

MB1504锁相环芯片的51单片机驱动程序,可以根据需要修改合适的分频值来完成频率合成配置.

https://www.eeworm.com/dl/648/326867.html

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其他  华为的小数分频专利 PDF文档里面的内容比较详细分析了当前的小数分频方法以及专利小数分频方法的实现算法以及步骤

华为的小数分频专利 PDF文档里面的内容比较详细分析了当前的小数分频方法以及专利小数分频方法的实现算法以及步骤

https://www.eeworm.com/dl/534/327029.html

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汇编语言  74LS393和Intel8253中断应用采用74LS393对实验箱中8MHz时钟进行分频处理

74LS393和Intel8253中断应用采用74LS393对实验箱中8MHz时钟进行分频处理，从中获得低于2MHz的时钟信号￠，并将时钟信号￠输入给Intel8253的某通道C。要求通道C的输出信号作为Intel8259的可屏蔽中断请求IRQ2，使得中央处理器每隔2秒钟中断一次，中断程序将中断次数采用二进制方式在8个发光二极管中显示出来 ...

https://www.eeworm.com/dl/644/327475.html

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matlab例程  电子通信系统的建模与仿真第4章电子线路仿真试验 4.1 信号合并 4.2 微积分 4.3 触发器 4.4 分频器 4.5 使能开关 4.6 编程开关 4.7 移位寄存器

电子通信系统的建模与仿真第4章电子线路仿真试验 4.1 信号合并 4.2 微积分 4.3 触发器 4.4 分频器 4.5 使能开关 4.6 编程开关 4.7 移位寄存器 4.8 整流电路 4.9 驻波演示 4.10 超外差式接收机

https://www.eeworm.com/dl/665/342356.html

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VHDL/FPGA/Verilog 该源码为VHDL语言编写的分频器

该源码为VHDL语言编写的分频器，在W-4b教学平台上通过验证

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其他  分频器

分频器，用于时钟信号的分频及倍频，供专业人事学习研究使用

https://www.eeworm.com/dl/534/343673.html

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