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分线器 的查询结果
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VHDL/Verilog/EDA源码 用verilog实现fpga的通用分频器的实现
用verilog实现了奇数和偶数不同的分频器设计
应用设计 verilog设计三分频器代码
用verilog编写的三分频器代码，用modelsim测试没有问题，有问题请反馈给我
软件 庖丁解羊中文分词器
官方说明：“刨丁解羊中文分词器，主要用于对网络蜘蛛或网络爬虫抓取的网页进行分词，支持繁体中文分词、简体中文分词、英文分词，是制作通用搜索引擎和垂直搜索引擎的核心组件。该软件在普通PC机器上测试显示：TXT格式正文分词速度约为3000万字/分钟，网页分词速度约为277.8个网页/秒。该软件采用基础词库（63万词语）+ ...
技术资料 基于FPGA的分频器的设计与实现
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技术资料 一种基于FPGA的分频器的实现
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技术资料 FPGA_ASIC-基于CPLD FPGA的半整数分频器的设计讲解
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学术论文 基于FPGA采用PCM通信实现多路数据采集器的研制
本文研制的数据采集器，用于采集导弹过载模拟试车台的各种参数,来评价导弹在飞行过程中的性能，由于试车台是高速旋转体，其工作环境恶劣，受电磁干扰大，而且设备要求高，如果遇到设备故障或设备事故，其损失相当巨大，保证设备的安全性和可靠性较为困难。 本文在分析数字通信技术的基础上，选用了基于现场可编程逻辑阵列(F ...
经验分享 USB2.0走线要点
在绘制USB电源线、信号地和保护地时，应注意以下几点：
①USB插座的1、2、3、4脚应在信号地的包围范围内，而不是在保护地的包围范围
内。
②USB差分信号线和其他信号线在走线的时候不应与保护地层出现交叠。
③电源层和信号地层在覆铜的时候要注意不应与保护地层出现交叠。
④电源层要比信号地层内缩20D，D为电源层与信号 ...
教程资料 VHDL语言的高频时钟分频模块
VHDL语言的高频时钟分频模块。一种新的分频器实现方法。