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基于FPGA的分频器,可以根据更改参数,实现不同倍数的分频.
教程资料 FPGA设计分频器的多个源代码实例
fredivn.vhd 偶数分频\r\nfredivn1.vhd 奇数分频\r\nfrediv16.vhd 16分频\r\nPULSE.vhd 数控分频器
教程资料 FPGA显示时、分、秒源代码
可以显示时、分、秒,可以设置时间,精度要求0.001s ,允许电压: 3.3V\r\n
教程资料 5分鐘學會使用CPLD
5分鐘學會使用CPLD,经典资料,有想学习CPLD的朋友有福了
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教程资料 利用Allegro进行差分信号(Differential Signal)在高速电路设计需要注意的问题
差分信号(Differential Signal)在高速电路设计中的应用越来越广泛,差分线大多为电路中最关键的信号,差分线布线的好坏直接影响到PCB板子信号质量。