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找到约 9,064 项符合 分形理论 的查询结果

模拟电子 基于HVS的空域分块数字水印技术

 数字水印作为一种防护技术,在数字产品的保护认证方面越发显得重要,成为当前计算机领域研究的热点问题之一。提出了一种在空域采用分块重复嵌入水印信息和HVS相结合的水印技术。实验结果说明,分块技术在空域的使用提高了水印的嵌入强度和降低计算复杂度,该算法在抵抗旋转、裁剪、缩放方面等有较强能力;水印算法与H ...
https://www.eeworm.com/dl/571/21085.html
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模拟电子 基于帧间差分与模板匹配相结合的运动目标检测

基于图形处理器单元(GPU)提出了一种帧间差分与模板匹配相结合的运动目标检测算法。在CUDA-SIFT(基于统一计算设备架构的尺度不变特征变换)算法提取图像匹配特征点的基础上,优化随机采样一致性算法(RANSAC)剔除图像中由于目标运动部分产生的误匹配点,运用背景补偿的方法将静态背景下的帧间差分目标检测算法应用于动态 ...
https://www.eeworm.com/dl/571/21128.html
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模拟电子 ADC的九个关键指标

    模拟转换器性能不只依赖分辨率规格   大量的模数转换器(ADC)使人们难以选择最适合某种特定应用的ADC器件。工程师们选择ADC时,通常只注重位数、信噪比(SNR)、谐波性能,但是其它规格也同样重要。本文将介绍ADC器件最易受到忽视的九项规格,并说明它们是如何影响ADC性能的。   1. SNR比分辨率更为重 ...
https://www.eeworm.com/dl/571/21347.html
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模拟电子 时钟分相技术应用

摘要: 介绍了时钟分相技术并讨论了时钟分相技术在高速数字电路设计中的作用。 关键词: 时钟分相技术; 应用 中图分类号: TN 79  文献标识码:A   文章编号: 025820934 (2000) 0620437203 时钟是高速数字电路设计的关键技术之一, 系统时钟的性能好坏, 直接影响了整个电路的 性能。尤其现代电子系统对性能的越来越高 ...
https://www.eeworm.com/dl/571/21436.html
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PCB相关 PCB布线的直角走线、差分走线和蛇形线基础理论

PCB布线的直角走线、差分走线和蛇形线基础理论
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PCB相关 差分线对的PCB设计要点

  信号完整性是高速数字系统中要解决的一个首要问题之一,如何在高速PCB 设计过程中充分考虑信号完整性因素,并采取有效的控制措施,已经成为当今系统设计能否成功的关键。在这方面,差分线对具有很多优势,比如更高的比特率 ,更低的功耗 ,更好的噪声性能和更稳定的可靠性等。目前,差分线对在高速数字电路设计中的 ...
https://www.eeworm.com/dl/501/22222.html
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PCB相关 PCB布线知识面试题_PCB工程师必备

本内容汇总了近30个PCB布线知识面试题是PCB工程师必备的知识点总结,也是面试者需要的知识。如何处理实际布线中的一些理论冲突的问题,在高速设计中,如何解决信号的完整性问题?差分布线方式是如何实现的?对于只有一个输出端的时钟信号线,如何实现差分布线?等问题 ...
https://www.eeworm.com/dl/501/22227.html
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PCB相关 差分信号PCB布局布线误区

 误区一:认为差分信号不需要地平面作为回流路径,或者认为差分走线彼此为对方提供回流途径。造成这种误区的原因是被表面现象迷惑,或者对高速信号传输的机理认识还不够深入。虽然差分电路对于类似地弹以及其它可能存在于电源和地平面上的噪音信号是不敏感的。地平面的部分回流抵消并不代表差分电路就不以参考平面作 ...
https://www.eeworm.com/dl/501/22240.html
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PCB相关 PCB LAYOUT设计规范手册

  PCB Layout Rule Rev1.70, 規範內容如附件所示, 其中分為:   (1) ”PCB LAYOUT 基本規範”:為R&D Layout時必須遵守的事項, 否則SMT,DIP,裁板時無法生產.   (2) “錫偷LAYOUT RULE建議規範”: 加適合的錫偷可降低短路及錫球.   (3) “PCB LAYOUT 建議規範”:為製造單位為提高量產良率,建議R&D在design階段即加入PC ...
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PCB相关 电路板噪声原理和噪声抑制

  在模拟电路中的地线设计与数字电路中的地线设计,理论上要分开走,这样可以用不同标准的耦合电容去除,数字电路中的地线是DGND,模拟电路中的地线是AGND,而打磨三诺音箱中的功放部分,是典型的对模拟放大电路的打磨,因此功放中提到的地线就是AGND。 ...
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