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减振器设计 的查询结果
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单片机开发 单片机无线串行接口电路的设计:介绍一种采用MICRF102单片发射器芯片、MICRF007单片接收器芯片构成的单片机无线串行接口电路。
单片机无线串行接口电路的设计:介绍一种采用MICRF102单片发射器芯片、MICRF007单片接收器芯片构成的单片机无线串行接口电路。
软件设计/软件工程 自适应回波抵消器和语音编解码器的设计实现.
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DPLL由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成.
整个系统的中心频率(即signal_in和signal_out的码速率的2倍)
为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低. ...
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设计功能及要求
设计M=99的十进制加/减可逆计数器
(1)接通电源时电路能自启动;
(2)手动分别实现加、减计数和自动实现加减可逆计数;
(3)用数码管显示计数数值。
(4)给定元件:74LS192、74LS00、74LS76、74LS48及LED。 ...