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兆兆 的查询结果
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教程资料 JTAG CPLD实现源代码
JTAG CPLD实现源代码，比用简单并口调试器快5倍以上。\r\n以前总觉得简单的并口jtag板速度太慢，特别是调试bootloader的时候，简直难以忍受。最近没什么事情，于是补习了几天vhdl，用cpld实现了一个快速的jtag转换板。cpld用epm7128stc100-15，晶振20兆，tck频率5兆。用sjf2410作测试，以前写50k的文件用时5分钟，现在则是5 ...
模拟电子 基于选择进位32位加法器的硬件电路实现
为了缩短加法电路运行时间，提高FPGA运行效率，利用选择进位算法和差额分组算法用硬件电路实现32位加法器，差额分组中的加法单元是利用一种改进的超前进位算法实现，选择进位算法可使不同的分组单元并行运算，利用低位的运算结果选择高位的进位为1或者进位为零的运算结果，节省了进位选择等待的时间，最后利用XILINX进行时 ...
模拟电子 高速数据转换器评估平台(HSDCEP)用户指南评估
高速数据转换器评估平台(HSDCEP)是基于PC的平台，提供评估Maxim RF数/模转换器(RF-DAC，支持更新速率≥ 1.5Gsps)和Maxim数字上变频器(DUC)的齐全工具。HSDCEP可以在每对数据引脚产生速率高达1.25Gbps的测试码型，支持多达4条并行16位LVDS总线。通过USB 2.0端口将最长64兆字(Mw)、每字16位宽的数据码型装载至HSDCEP存储 ...
PCB相关 中兴通讯硬件巨作:信号完整性基础知识
中兴通讯硬件一部巨作－信号完整性
近年来，通讯技术、计算机技术的发展越来越快，高速数字电路在设计中的运用越来
越多，数字接入设备的交换能力已从百兆、千兆发展到几十千兆。高速数字电路设计对信
号完整性技术的需求越来越迫切。
在中、 大规模电子系统的设计中， 系统地综合运用信号完整性技术可以带来很多好处 ...
电源技术 六类线缆的隔离构件(工艺)
在过去10年中，满足高带宽应用需要的布线技术发生了巨大的变化，布线系统所支持的带宽已从最初10MHz发展到今天的250MHz。2002年6月，TIA/EIA组织最终核准了六类布线标准，将所有厂商的布线产品实现标准化，而网络设备制造商也将保证它们的设备在六类布线上高速运行。应该说，六类系统的推出为人类从真正意义上跨入千兆网络 ...
单片机编程 四档位智能型数字兆欧表的设计
关于数字欧姆表设计的介绍
单片机编程 单片机仿真机使用说明
主要功能和特性 1  支持串口的仿真功能 2  串口中断用户可以使用 3  不占用定时器 2 4  完全仿真 p0 p2 口 5  支持 89C52 等嵌入式 CPU仿真 6  占用用户堆栈 2 个字节 7  占用 1 条 I/O : P3.5 8  ISP  在线编程,在线下载 9  仿真频率最高 33 兆 10 支持同时最多 1 ...
单片机编程 LG-32K单片机仿真机使用说明
LG-32K是老古开发网推出的一个支持keilc51设计软件的软件断点仿真机使用一片SST89C58单片机和一片AT90S8515单片机来实现仿真功能(主CPU和用户CPU),两片CPU之间通过一根I/O引脚通讯(通讯速率在33兆晶振时约100KBPS),主CPU负责跟keilc51通讯,用户CPU只跟主CPU通讯. ...
单片机编程 单片机以太网通讯的实现介绍
本文介绍了以8051为例的单片机与10兆以太网控制器RTL8019AS的硬件连接电路的实现和编程方法。