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学术论文  基于FPGA的ADC并行测试方法研究

高性能ADC产品的出现，给混合信号测试领域带来前所未有的挑战。并行ADC测试方案实现了多个ADC测试过程的并行化和实时化，减少了单个ADC的平均测试时间，从而降低ADC测试成本。本文实现了基于FPGA的ADC并行测试方法。在阅读相关文献的基础上，总结了常用ADC参数测试方法和测试流程。使用FPGA实现时域参数评估算法和频域参数 ...

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C/C++语言编程  TCP IP 服务端与客户端示例程序

TcpIp使用方法在服务端运行tcp.exe, 在另一台与之在同一network的客户端上运行tcplnk.exe, 规定相同的port, 在服务端上begin, 在客户端上输入服务器的IP地址，connect, 客户端上编辑框中的字符便可send到客户端的编辑框中。

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实用工具  modbus调试软件

modbus协议调试软件，通讯地址、速率及效验方式，可通过软件修改产品参数。

https://www.eeworm.com/dl/551/16102.html

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实用工具  csdn免费下载器

免积分下载csdn文档，此版本为不成熟版。在软件输入条内输入文档号，即地址最后的数字。输入验证码后软件会解析出真是地址，可以免费下载

https://www.eeworm.com/dl/551/16482.html

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技术教程  AD10.0下载与破解详细教程

Altium Designer 10.0软件下载地址与安装，以及详细的破解教程

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EDA相关  CADSTAR11.0下载

CADSTAR11.0是日本的其中一个版本，里面是连接地址，永久有效。

https://www.eeworm.com/dl/543/16543.html

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开发工具  modelsim软件下载地址

fpga仿真必备软件，初学者必学软件。支撑verilger及vhdl仿真

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软件下载  Cadence Allegro 16.5 破解版高速下载+教程

2013.6.25重新上传。文件rar压缩，容量2.19GB。 Cadence Allegro 16.5 crack 修正破解方法支持 windows 7 具体的步骤： . 1、下载SPB16.5下来后，点setup.exe,先安装第一项licensemanager，问license时，单击cancel，然后finish. . 2、接下来安装cadence的product,即第二项,直到安装结束这个时间有点长装过以前版 ...

https://www.eeworm.com/dl/cadence/software/2013-07-23/17466.html

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教程资料  基于Xilinx FPGA的DDRSDRAM的Verilog控制代码

基于Xilinx FPGA的DDRSDRAM的Verilog控制代码，使用的FPGA为Virtex-4，实现对DDRSDRAM的简单控制（对一系列地址的写入和读取）。

https://www.eeworm.com/dl/fpga/doc/17547.html

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教程资料  用FPGA 实现基- 4FFT 算法

针对高速数字信号处理的要求,提出用FPGA 实现基- 4FFT 算法,并对其整体结构、蝶形单\\\\\\\\r\\\\\\\\n元进行了分析. 采用蝶算单元输入并行结构和同址运算,能同时提供蝶形运算所需的4 个操作\\\\\\\\r\\\\\\\\n数,具有最大的数据并行性,能提高处理速度按照旋转因子存放规则,蝶形运算所需的3 个旋转\\\\\\\\r\\\\\\\\n因子 ...

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