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倍频器 的查询结果
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VHDL/FPGA/Verilog 该文件可用vhdl语言实现时钟8倍频
该文件可用vhdl语言实现时钟8倍频，运行环境可在maxplus2和ise的仿真软件上
VHDL/FPGA/Verilog 这是用VHDL语言写的32位分频器的程序
这是用VHDL语言写的32位分频器的程序，可直接运行，看结果，欢迎使用。多指正，交流。
VHDL/FPGA/Verilog 分频器 几次分频欧次分频 vhdl 语言实现
分频器 几次分频欧次分频 vhdl 语言实现
其他嵌入式/单片机内容 带分频器的bcd计数电路设计
带分频器的bcd计数电路设计，verilog源码
VHDL/FPGA/Verilog 测频器
测频器，用VHDL语言编写。新手学习作品，还有好多不完善的地方，全当交流，也希望能下载本站原码学习。
VHDL/FPGA/Verilog 半整数分频器电路的VHDL源程序
半整数分频器电路的VHDL源程序，供大家学习和讨论。
单片机开发 此程序为方波频率的检测和倍频的程序,希望对大家有点帮助
此程序为方波频率的检测和倍频的程序,希望对大家有点帮助
VHDL/FPGA/Verilog 用VHDL编写的8位全加器,数字分频器等程序
用VHDL编写的8位全加器,数字分频器等程序
VHDL/FPGA/Verilog 第7章数字系统设计实例 7.1 半整数分频器的设计 7.2 音乐发生器 7.3 2FSK/2PSK信号产生器 7.4 实用多功能电子表 7.5 交通灯控制器 7.6 数字频率计
第7章数字系统设计实例
7.1 半整数分频器的设计
7.2 音乐发生器
7.3 2FSK/2PSK信号产生器
7.4 实用多功能电子表
7.5 交通灯控制器
7.6 数字频率计
中间件编程 在FPGA或CPLD上实现的一中非常实用的倍频电路
在FPGA或CPLD上实现的一中非常实用的倍频电路，只要输入频率高，精度就很高