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模拟电子 基于MC9S08SL8的电动汽车仪表盘信号转换器设计

笔者以Freescale的S08系列8位微处理器MC9S08SL8为核心,为某电动汽车设计了一款仪表盘信号转换器,实现了电机转速检测、与电机控制器的LIN通信、原车仪表信号模拟等功能。利用芯片内部资源特性设计了其硬件结构及电路,根据仪表盘的原理和工作方式设计了软件流程,装车试验运行稳定,有很高的实用价值。 ...
https://www.eeworm.com/dl/571/20256.html
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PCB相关 信号完整性知识基础(pdf)

现代的电子设计和芯片制造技术正在飞速发展,电子产品的复杂度、时钟和总线频率等等都呈快速上升趋势,但系统的电压却不断在减小,所有的这一切加上产品投放市场的时间要求给设计师带来了前所未有的巨大压力。要想保证产品的一次性成功就必须能预见设计中可能出现的各种问题,并及时给出合理的解决方案,对于高速的数字电路 ...
https://www.eeworm.com/dl/501/22287.html
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DSP编程 基于DSP Builder数字信号处理器的FPGA设计

针对使用硬件描述语言进行设计存在的问题,提出一种基于FPGA并采用DSP Builder作为设计工具的数字信号处理器设计方法。并按照Matlab/Simulink/DSP Builder/QuartusⅡ设计流程,设计了一个12阶FIR 低通数字滤波器,通过Quartus 时序仿真及嵌入式逻辑分析仪SignalTapⅡ硬件测试对设计进行了验证。结果表明,所设计的FIR 滤波 ...
https://www.eeworm.com/dl/516/31995.html
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教程资料 对Altera 28nm FPGA浮点DSP设计流程和性能的独立分析

  电子发烧友网核心提示:Altera公司昨日宣布,在业界率先在28 nm FPGA器件上成功测试了复数高性能浮点数字信号处理(DSP)设计。独立技术分析公司Berkeley设计技术有限公司(BDTI)验证了能够在 Altera Stratix V和Arria V 28 nm FPGA开发套件上简单方便的高效实现Altera浮点DSP设计流程,同时验证了要求较高的浮点DSP ...
https://www.eeworm.com/dl/fpga/doc/32290.html
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无线通信 GLONASS卫星信号的捕获及其仿真

本文通过介绍GLONASS卫星信号的组成和特性,分析了广泛用于卫星信号捕获的串行二维搜索捕获算法的算法原理;在考虑算法实现所需要的时间和涉及的计算量的前提下,分析了计算量较少,捕获时间较短的并行码相位搜索和部分匹配滤波两种捕获算法,对两种算法的算法流程进行了详细的分析,并利用matlab对算法进行仿真实现,成功 ...
https://www.eeworm.com/dl/510/36278.html
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可编程逻辑 对Altera 28nm FPGA浮点DSP设计流程和性能的独立分析

  电子发烧友网核心提示:Altera公司昨日宣布,在业界率先在28 nm FPGA器件上成功测试了复数高性能浮点数字信号处理(DSP)设计。独立技术分析公司Berkeley设计技术有限公司(BDTI)验证了能够在 Altera Stratix V和Arria V 28 nm FPGA开发套件上简单方便的高效实现Altera浮点DSP设计流程,同时验证了要求较高的浮点DSP ...
https://www.eeworm.com/dl/kbcluoji/39336.html
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可编程逻辑 信号完整性知识基础(pdf)

现代的电子设计和芯片制造技术正在飞速发展,电子产品的复杂度、时钟和总线频率等等都呈快速上升趋势,但系统的电压却不断在减小,所有的这一切加上产品投放市场的时间要求给设计师带来了前所未有的巨大压力。要想保证产品的一次性成功就必须能预见设计中可能出现的各种问题,并及时给出合理的解决方案,对于高速的数字电路 ...
https://www.eeworm.com/dl/kbcluoji/40408.html
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测试测量 基于OMAPLI1X的轨道移频信号测试系统的软件设计

在轨道信号检测中,如何高精度的检测出当前的轨道移频信号一直是保证列车安全运行的重要课题。根据我国轨道移频信号的特点,在采用OMAP L137芯片为主的硬件平台下,采用欠采样和ZFFT的方法对移频信号进行检测,并阐述将算法在硬件平台下实现的流程,为便携式测试仪的设计提供基础。该系统实时性高,稳定性好,可扩展性强。 ...
https://www.eeworm.com/dl/544/41792.html
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matlab例程 cdma信号处理的matlab仿真

cdma信号处理的matlab仿真,包括信号的编码和调制等流程
https://www.eeworm.com/dl/665/135217.html
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VHDL/FPGA/Verilog 本代码介绍了使用VHDL开发FPGA的一般流程

本代码介绍了使用VHDL开发FPGA的一般流程,最终采用了一种基于FPGA的数字频率的实现方法。该设计采用硬件描述语言VHDL,在软件开发平台ISE上完成,可以在较高速时钟频率(100MHz)下正常工作。该设计的频率计能准确的测量频率在1Hz到100MHz之间的信号。使用ModelSim仿真软件对VHDL程序做了仿真,并完成了综合布局布线,最终 ...
https://www.eeworm.com/dl/663/219674.html
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