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教程资料  Quartus仿真步骤

qutus软件仿真步骤。很全的哦

https://www.eeworm.com/dl/fpga/doc/32256.html

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教程资料  Altera可重配置PLL使用手册0414-3

Altera可重配置PLL使用手册0414-3。

https://www.eeworm.com/dl/fpga/doc/32274.html

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教程资料  WP374 Xilinx FPGA的部分重配置

WP374 Xilinx FPGA的部分重配置

https://www.eeworm.com/dl/fpga/doc/32565.html

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教程资料  扩频测距快速捕获仿真分析

通过运用FFT IP Core计算收发序列间的互相关函数,可以实现快速捕获。仿真结果表明,该方法具有速度快、误差小、设计灵活、效率高的特点。

https://www.eeworm.com/dl/fpga/doc/32608.html

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教程资料  Multisim的时序逻辑电路设计仿真

通过介绍Multisim软件的功能和特点,结合格雷玛计数器的设计实例,叙述了在Multisim软件平台进行时序逻辑电路的设计原理及构成方法,并利用软件对设计进行仿真。

https://www.eeworm.com/dl/fpga/doc/32610.html

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教程资料  WP253 - 简化FPGA配置设计过程

&nbsp; 本文着重介绍了 Xilinx Platform Flash PROM 如何帮助系统和电路板设计人员简化 FPGA 配置设计。用于配置 FPGA 的可选解决方案有很多，但它们通常都需要大量的前期设计工作和时间。Platform Flash 是为配置 Xilinx FPGA 专门设计的一款包括硬件和软件支持在内的整体解决方案。 ...

https://www.eeworm.com/dl/fpga/doc/32617.html

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教程资料  LTE标准下Turbo码编译码器的集成设计

针对固定码长Turbo码适应性差的缺点，以LTE为应用背景，提出了一种帧长可配置的Turbo编译码器的FPGA实现方案。该设计可以依据具体的信道环境和速率要求调节信息帧长，平衡译码性能和系统时延。方案采用“自顶向下”的设计思想和“自底而上”的实现方法，对 Turbo编译码系统模块化设计后优化统一，经时序仿真验证后下载配置 ...

https://www.eeworm.com/dl/fpga/doc/32661.html

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教程资料  Spartan-3 FPGA 的 3.3V 配置应用指南

摘要:本应用指南提供了一种方法可从3.3V接口对Spartan™-3和Spartan-3L FPGA进行配置。它针对每种配置模式都提供了一组经验证的连接框图。这些框图是完整且可直接使用的解决方案。

https://www.eeworm.com/dl/fpga/doc/32682.html

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教程资料  可重配置PLL使用手册

本文档主要是以Altera公司的Stratix II系列的FPGA器件为例，介绍了其内嵌的增强型可重配置PLL在不同的输入时钟频率之间的动态适应，其目的是通过提供PLL的重配置功能，使得不需要对FPGA进行重新编程就可以通过软件手段完成PLL的重新配置，以重新锁定和正常工作。 ...

https://www.eeworm.com/dl/fpga/doc/32683.html

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教程资料  基于FPGA的高速电路设计与仿真

现代数字信号处理从视频扩展到了中频甚至射频,针对要求信号处理的处理速度越来越高、传输速率越来越快等特点,给出了一款使用高性能FPGA、DAC以及经先进的PCB设计工具设计、仿真的高速信号处理模块,实现了对高速信号的实时接收和处理。关键词:数字信号处理; 高速电路; FPGA;设计与仿真 ...

https://www.eeworm.com/dl/fpga/doc/32700.html

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