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VHDL/FPGA/Verilog 该代码为配合7号信令模块MK50H27的cpld(xilinx 95144)的逻辑代码,其中包括了VHDL及原理图.

该代码为配合7号信令模块MK50H27的cpld(xilinx 95144)的逻辑代码,其中包括了VHDL及原理图.

https://www.eeworm.com/dl/663/168829.html

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其他嵌入式/单片机内容  这是用AHDL语言即abel语言编写的逻辑可编程器件原代码！供大家参考！

这是用AHDL语言即abel语言编写的逻辑可编程器件原代码！供大家参考！

https://www.eeworm.com/dl/687/172366.html

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Java编程  java网站源代码,有数据库的操作代码,业务逻辑代码等内容

java网站源代码,有数据库的操作代码,业务逻辑代码等内容

https://www.eeworm.com/dl/633/179573.html

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Java编程  p2p仿真器。开发者可以工作在覆盖层中进行创造和测试逻辑算法或者创建和测试新的服务。PlanetSim还可以将仿真代码平稳转换为在Internet上的实验代码

p2p仿真器。开发者可以工作在覆盖层中进行创造和测试逻辑算法或者创建和测试新的服务。PlanetSim还可以将仿真代码平稳转换为在Internet上的实验代码，模拟器上的分布式服务对结构化的覆盖层协议使用相同API，在模拟器和底层网络上的服务并且对用户是透明的。 ...

https://www.eeworm.com/dl/633/219550.html

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其他  alu算术逻辑运算单元主要代码运行环境为QU6.0

alu算术逻辑运算单元主要代码运行环境为QU6.0

https://www.eeworm.com/dl/534/255269.html

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嵌入式/单片机编程  深圳优龙公司PXA270的cpld的vhdl逻辑代码

深圳优龙公司PXA270的cpld的vhdl逻辑代码，

https://www.eeworm.com/dl/647/258671.html

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嵌入式/单片机编程  译码器的逻辑功能是将已赋予特定含义的一组二进制输入代码的原意"翻译"出来,变成对应的输出高低电平信号.该程序为3-8译码器.基于VHDL,其开发环境是MAXPLUS2.

译码器的逻辑功能是将已赋予特定含义的一组二进制输入代码的原意"翻译"出来,变成对应的输出高低电平信号.该程序为3-8译码器.基于VHDL,其开发环境是MAXPLUS2.

https://www.eeworm.com/dl/647/269003.html

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单片机开发  最新版本1.7.老外编的,编辑梯子逻辑到PIC16或者AVR 代码。如下内容处理器被支持： PIC16F877 PIC16F628 PIC16F876(未受测试) PI

最新版本1.7.老外编的,编辑梯子逻辑到PIC16或者AVR 代码。如下内容处理器被支持： *PIC16F877 *PIC16F628 *PIC16F876(未受测试) *PIC16F88(未受测试) *PIC16F819(未受测试) *ATmega128 *ATmega64 *ATmega162(未受测试) *ATmega32(未受测试) *ATmega16(未受测试) *ATmega8(未受测试) ...

https://www.eeworm.com/dl/648/303192.html

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VHDL/FPGA/Verilog 基于GAL16V8D的一个时钟整开逻辑代码.Verilog编写!

基于GAL16V8D的一个时钟整开逻辑代码.Verilog编写!

https://www.eeworm.com/dl/663/303285.html

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VHDL/FPGA/Verilog I2C总线的逻辑代码.Verilog编写!很好用.调试成功.

I2C总线的逻辑代码.Verilog编写!很好用.调试成功.

https://www.eeworm.com/dl/663/303286.html

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